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이한수,함창모 한국세무회계학회 2003 세무회계연구 Vol.13 No.-
외환위기 이후 정부의 재무구조개선정책과 관련하여 기업들은 부채비율을 줄이기 위한 자구적 노력과 함께 새로운 환경에 적응하기 위한 자금조달의사결정을 필요로 하게 되었다. 이러한 시점에서 본 연구는 조세정책상의 방향제시를 위해 자금조달결정에 미치는 조세효과를 분석하고자 하였으며 이러한 조세효과의 검증은 부채감세수단과 비부채감세수단가의 대체효과와 감세수단간의 대체관계는 조세소모의 정도에 따라 다르게 나타날 것이라는 조세소모효과에 중점을 두어 수행하였다. 실증분석을 위해 상장제조기업을 중심으로 하는 730개의 기업-연도표본을 대상으로 회귀분석을 실시하였으며 실증분석결과를 통해 부채감세수단은 비부채감세수단과 유의적인 음(-)의 관계를 보이며 대체관계에 있으며 감세수단간의 대체관계는 조세소모의 정도가 심할수록 보다 크게 나타날 것이라는 조세소모효과를 확인할 수 있었다. 또한 감세수단의 관리 및 의사결정에서 감세수단을 고려하는 조세기획력의 차이를 감안하여 기업규모별로 조세소모정도를 반영한 감세수단간의 대체관계를 비교한 결과에서는 대규모 기업군에서 상대적으로 강한 음(-)의 관계를 나타내었다. 이러한 결과들은 우리나라 기업들이 자금조달 의사결정시에 부채사용에 따른 이자비용의 감세효과를 고려하고 있으나 감세수단간의 대체관계에 따른 조세관리는 상대적으로 조세기획력이 우월한 대기업을 중심으로 이루어지고 있음을 시사한다.
Pd/SDBC 촉매의 중수소 - 수증기간의 중수소 교환반응
이한수,김광락,이성호,백승우,정흥석,강희석,안도희 한국공업화학회 1998 응용화학 Vol.2 No.2
The Pd/SOBC catalysts were prepared in order to develop the wet-proofed catalyst for the deuterium exchange reaction between deuterated hydrogen and water vapor. The reactivity of the catalysts for the hydrogen isotope exchange reaction was tested under the boiling point of water. The experiments for the reaction were conducted to compare the efficiency of the Pd/SDBC catalyst with that of the Pd-Pt/SDBC catalysts. The experimental results showed that the Pd-Pt/SDBC had higher catalytic activity for the reaction than Pd/SDEC catalyst. In this study, it was found that the catalytic activity of Pd/SDBC catalyst was enhanced by the addition of small amounts of platinum.
Self Calibration Current Bias 회로에 의한 10-bit 100 MSPS CMOS D/A 변환기의 설계
李漢洙,송민규,宋元哲 대한전자공학회 2003 電子工學會論文誌-SD (Semiconductor and devices) Vol.40 No.11
In this paper, a highly linear and low glitch CMOS current mode digital-to-analog converter (DAC) by self calibration bias circuit is proposed. The architecture of the DAC is based on a current steering 6+4 segmented type and new switching scheme for the current cell matrix, which reduced non-linearity error and graded error. In order to achieve a high performance DAC , novel current cell with a low spurious deglitching circuit and a new inverse thermometer decoder are proposed. The prototype DAC was implemented in a 0.35um n-well CMOS technology. Experimental result show that SFDR is 60 dB when sampling frequency is 32MHz and DAC output frequency is 7.92MHz. The DAC dissipates 46 mW at a 3.3 Volt single power supply and occupies a chip area of 1350um×750um. 본 논문에서는 빠른 정착시간을 갖는 전류셀(Current Cell) 매트릭스의 구조와 출력의 Gain error를 보정할 수 있는 Self calibration current bias 회로의 기능을 가진 고성능 10-bit D/A 변환기를 제안한다. 매트릭스 구조 회로의 복잡성으로 인한 지연시간의 증가 및 전력 소모를 최소화하기 위해 상위 6MSB (Most Significant Bit)전류원 매트릭스와 하위 4LSB(Least Significant Bit)전류원 매트릭스로 구성된 2단 매트릭스 구조로 설계되어 있다. 이러한 6+4 분할 구조를 사용함으로써 전류 원이 차지하는 면적과 Thermometer decoder 부분의 논리회로를 가장 최적화 시켜 회로의 복잡성과 Chip 사이즈를 줄일 수 있었고 낮은 Glitch 특성을 갖는 저 전력 D/A 변환기를 구현하였다. 또한 Self Calibration이 가능한 Current Bias를 설계함으로서 이전 D/A 변환기들의 칩 외부에 구현하던 Termination 저항을 칩 내부에 구현하고 출력의 선형성 및 정확성을 배가시켰다. 본 연구에서는 3.3V의 공급전압을 가지는 0.35㎛ 2-poly 4-metal N-well CMOS 공정을 사용하였고, 모의 실험결과에서 선형성이 매우 우수한 출력을 확인하였다. 또한 소비전력은 45mW로 다른 10bit D/A 변환기에 비해 매우 낮음을 확인 할 수 있었다. 실제 제작된 칩은 Spectrum analyzer에 의한 측정결과에서 100MHz 샘플링 클럭 주파수와 10MHz 입력 신호 주파수에서 SFDR은 약 65dB로 측정되었고, INL과 DNL은 각각 0.5 LSB 이하로 나타났다. 유효 칩 면적은 Power Guard ring을 포함하여 1350um × 750 um 의 면적을 갖는다.
이한수,이장희 충북대학교 산업경영연구소 1994 産業과 經營 Vol.7 No.1
본 연구에서는 경영자의 회계선택에 관한 대체적 가설중 부채지분가설에 의하여 우리나라 경영자의 회계정책 결정을 설명할 수 있는지에 관한 검증을 하였다. 연구방법으로는 회계절차 선택의 종합적 측정변수로 당기순이익을 영업활동에서 조달된 현금흐름으로 차감한 총발생액을 종속변수로 하고 지분구조 변수인 부채비율을 설명변수로 총자산을 규모변수로 하는 통제변수를 이용한 회귀분석에 의하여 지분구조의 회계선택에 대한 영향을 분석하였다. 연구결과에 의하면 연구가설과 같이 부채비율의 회귀계수는 통계적으로 유의한 것으로 나타나 부채비율이 높은 기업은 미래의 이익을 당기로 이전하여 지분구조를 안정시키는 회계절차를 선택하고 있는 것으로 나타났다. 따라서 기업의 지분구조는 경영자의 회계절차의 선택 동기에 영향을 미치는 것으로 나타났다.