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초고속 광 코드분할 다원접속 네트웍용 최적 2차 코드 생성 알고리즘 제안 및 연구
신종윤,박남규 한국광학회 2002 한국광학회지 Vol.13 No.5
본 논문에서는 초고속 광 코드분할 다원접속(OCDMA)네트웍을 위해 최적 2차원 코드 생성 알고리즘을 제안하고, 동시 사용자에 의한 다중접속간섭뿐만 아니라 백색잡음, 스펙트럼 효율을 고려한 성능을 평가하였다. 그 결과 조합론을 이용한 생성 알고리즘으로 얻어 낼 수 있는 최적 2차원 코드는 초고속 광 네트윅을 위한 코드에 적합하며, 기존 제안된 코드들에 비해서 비트 오류율이 같거나 작으면서 코드길이가 짧고 상대적으로 많은 코드 수를 가진다. 이는 WDM 시스템보다도 스펙트럼을 효율적으로 사용할 가능성을 보여준다. 또한 수신단, 채널 등의 백색 잡음을 고려한 보다 정밀한 비트 오류율을 유도하고 이를 이용하여 동시 사용자 수와 적절한 신호 대 잡음비에서 최적의 비트오류율을 얻기 위한 수신단에서의 최적의 문턱값을 찾아낼 수 있다. In this paper, we propose an optimal 2-dimensional construction algorithm of a code family for a high-speed optical code division multiple access network. The optimal 2-D code family generated by search algorithm has better spectrum efficiency than previous codes, having relatively many code sets with short code length and the same or lower BER. Using the optimal 2-D code, OCDMA systems make it possible to utilize the spectrum more efficiently than WDM systems. The probability of bit error for high-speed OCDMA transmissions is calculated as a function of the number of users in the presence of receiver and shot noise(additive white Gaussian noise).
신종윤,안계현,김승환,김종호,양충열,고제수,Shin, J.Y.,Ahn, K.H.,Kim, S.H.,Kim, J.H.,Yang, C.Y.,Ko, J.S. 한국전자통신연구원 2009 전자통신동향분석 Vol.24 No.1
최근 높은 대역폭을 요구하는 애플리케이션이 증가하면서 10G 이더넷이 활발히 도입되고 있으나, 트래픽의 집중화가 계속 진행되고 있어서 더욱 큰 대역폭을 제공할 수 있는 100G급 이더넷 기술이 요구되고 있다. 100G 이더넷은 단거리 서버 환경을 지원하는 40G 이더넷과 함께 IEEE 802.3에서 표준화를 진행하고 있으며 2010년 완료를 목표로 하고 있다. 그리고 ITU-T SG15에서는 100G급 OTN 신호에 대한 논의가 활발히 진행되고 있다. 본 고에서는 40G/100G 이더넷 표준화 동향과 이슈들에 대해 살펴보고, 관련 MAC/PHY 기술과 OTN 전송 기술에 대해 살펴 본다.
신종윤,정환석,김승환,고제수,김광준,Shin, J.Y.,Chung, H.S.,Kim, S.H.,Ko, J.S.,Kim, K. 한국전자통신연구원 2010 전자통신동향분석 Vol.25 No.6
고대역폭을 요구하는 새로운 서비스의 등장이 계속 이어지고 있어 수 년내 초광대역 시대가 도래할 것으로 예상된다. 이에 대비하여 다양한 광전송대역폭확장 기술이 등장하고 있으며, 나아가 시장 선점을 위한 실상용화를 서두르고 있다. 본 고에서는 초광대역 서비스 전달을 위해 요구되는 광전송망과 핵심 요소기술들을 살펴보고, 최근 경쟁적으로 기술 확보에 관심을 기울이고 있는 100Gbps 변복조, 100Gbps OTN, 100Gbps 이더넷 기술에 대한 기술 동향과 모듈 개발 동향, 또한 100G 이후 등장이 예상되는 새로운 광전송 분야와 이를 위해 극복해야 할 한계 기술에 대해 기술한다.
Continuous-time delta-sigma modulator using asynchronous SAR quantizer and digital ΔΣ Truncator
신종윤,박상규 한국과학기술원 반도체설계교육센터 2018 IDEC Journal of Integrated Circuits and Systems Vol.4 No.3
As the demand for IoT related devices has increased recently, the demand for voice sensors used in these devices is increasing. Low power is a key factor because these devices have to run on batteries for long periods of time. A delta-sigma modulator is best suited for analog-to-digital converters used in the voice signal band because resolution is more important than speed. This delta sigma modulator requires a high SQNR in order to obtain high resolution, indicating that a high bit number quantizer is required. However, a high bit number quantizer requires a large number of comparators and DACs, which increases power consumption and takes up a large area. In this paper, to achieve low noise and low power dissipation, 3rd order continuous time delta-sigma (DS) ADC with a 6-bit asynchronous successive approximation register (ASAR) quantizer and a digital delta-sigma truncator which reduce a number of DACs is presented. The designed ADC front-end has been implemented through a 180 nm CMOS process and achieved 86 dB SNR and 76 dB SNDR over a 20 kHz signal band. The total chip dissipates a power of 170μW from a 1.5 V supply.