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JPEG2000을 위한 스칼라양자화 및 컨텍스트 추출부 IP 설계 및 구현
정재형,홍성훈 전남대학교 전자통신기술연구소 2002 전자통신기술논문지 Vol.5 No.1
With the increasing use of multimedia technologies, image compression requires higher performances as well as new feature. To address this need in the specific area of still image encoding, a new standard is currently being developed, the JPEG2000. In this paper^(2), we propose scalar quantization and context extractior IP's architecture for JPEG2000 design as well as design and verify the IP's of its functional blocks. IP of each block is performed the software simulation to verity the validity of implemental structure, and then designed a HDL code according to 'RTL Coding Guideline' presented by SIPAC(System Integration & Intellectual Property Authoring Center). The designed IP's are implemented and verified on the Xillinx million gate FPGA test board and are fabricated to IDEC MPW chip by using Hynix 0.35㎛ library.
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