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너비 우선 탐색 역방향 마스킹 알고리듬에 의한 고속 경로 지연 고장 시뮬레이션
허용민 ( Yong-min Hur ) 한국고등직업교육학회 2002 한국고등직업교육학회논문집 Vol.3 No.2
This paper proposes an efficient parallel pattern path delay fault simulator for digital circuits. The proposed path delay fault simulator reduces simulation time of robust and nonrobust path delay fault by using the structural path graph and the parallel pattern processing technique in which 32 pairs of patterns are simulated at a time. Also, a backward masking algorithm based on the breadth first searching is proposed in order to detect paths sensitized from Pis (Primary Inputs) to POs (Primary Outputs) without trial and error. Based on the proposed algorithm, path fault analysis time and memory requirement are reduced by identifying the logic values in advance which are not propagated from PIs to POs, and the simulation speed is enhanced by efficient processing of maintenance of data structure which stores the information of detected paths. The proposed fault simulation is implemented by yacc and C language on a SUN SPARC station, and simulation results on ISCAS85 benchmark circuits with pseudo random pattern generated by LFSRs (Linear Feedback Shift Registers) show the efficiency and validity of the proposed fault simulator.
멀티 프로세서 시스템상의 계층적 캐시 메모리의 성능평가
김용국(Yong Kook Kim),허용민(Yong Min Hur),박홍준(Hong Jun Park),김영우(Young Oo Kim),박동규(Dong Gyu Park),윤용호(Young Ho Yun),임인철(In Chil Lim) 한국정보과학회 1992 한국정보과학회 학술발표논문집 Vol.19 No.2
본 논문에서는 packet-switched 버스를 사용한 멀티 프로세서 시스템상의 2-레벨 캐시 메모리 및 캐시 코히어런스 프로토콜의 성능을 평가하는 위한 트레이스 구등(trace-driven) 시뷸레이터를 개발한다. 시뮬레이터에 입력으로 사용되는 트레이스는 해석적으로 생성했으며, 이것을 이용하여 밀결합 멀티 프로세서 시스템상에서 캐시 메모리의 크기 및 플레이스먼트(placement) 기법에 따른 2-레벨 캐시 메모리의 성능을 비교 평가한다.
네트워크 보안 기능을 갖는 패킷처리 기반의 링크 통합 장비 설계
신재흥(Jae-Heung Shin),김홍렬(Hong-Ryul Kim),이상하(Sang-Ha Lee),허용민(Yong-Min Hur),이상철(Sang-Cheol Lee) 대한전기학회 2011 전기학회논문지 P Vol.60 No.3
The technology to build high speed network using low cost DSL in the areas where the cost to build high speed network is high and the network environment is not very accommodating is important in providing the high speed network that meets the user demand and utilizing the network resources in an efficient way. This study presents development of the link aggregation equipment that performs the access control and firewall functions for packet processing based LAN users. The equipments developed support up to 5 line link aggregation as opposed to current 2 line link aggregation. The equipments also allow the use of high speed network in the areas where the network environment is not very accommodating. Also, the fail-over function is added to each line to provide reliability and the self-security function is enhanced to protect the network from unauthorized use and prevents waste of network resources by authorized users.
Packet processing 기반의 네트워크 보안과 Multi-pair link aggregation
신재흥(Jae-Heung Shin),이상하(Sang-Ha Lee),김홍렬(Hong-Ryul Kim),허용민(Yong-Min Hur),이상철(Sang-Cheol Lee),김병직(Byung-Jik Kim) 대한전기학회 2010 대한전기학회 학술대회 논문집 Vol.2010 No.7
네트워크 환경이 열악한 지역 또는 고성능 네트워크의 구축비용이 높은 지역에서 저렴한 DSL과 같은 회선을 활용하여 고성능의 네트워크를 구축할 수 있는 기술은 소비자의 요구에 부응할 수 있으며, 네트워크 자원 활용 측면에서도 중요한 역할을 할 수 있다. 본 연구에서는 LAN 사용자 보안을 위한 접근제어(Access control) 및 방화벽 기능을 포함하는 링크 집선(Link Aggregation) 장비를 위한 기술을 개발하였다. 개발된 기술은 통상적으로 2개 회선을 이용한 링크 집선과 달리 최대 5개 회선까지 링크 집선을 지원하여 낮은 네트워크 성능을 사용하는 지역 또는 환경에서도 고성능의 네트워크를 사용할 수 있도록 한다. 또한 각 회선에 대한 페일오버(fail-over) 기능을 추가하여 고성능 네트워크에 대한 신뢰도를 보장하고, 제한된 네트워크 성능을 최대한 활용할 수 있도록 자체 보안 기능을 강화하여 외부 침입에 대한 방어뿐만 아니라, 내부 사용자에 의한 네트워크 자원 낭비를 방지 할 수 있게 하였다.
손윤식(Yoon-Sik Son),이인학(In-Hack Lee),박준(Joon Park),류근장(Keun-Jang Ryoo),신재흥(Jae-Heung Shin),허용민(Yong-Min Hur),김윤홍(Yoon-Hong Kim),한석붕(Seok-Bung Han),임인칠(In-Chil Lim) 한국정보과학회 1993 한국정보과학회 학술발표논문집 Vol.20 No.2
본 논문에서는 조합논리회로의 경로지연고장을 위한 효율적인 고장시뮬레이션 알고리즘을 제안한다. 제안하는 고장시뮬레이션 알고리즘은 동시성 고장시뮬레이션 방식을 사용하며 시뮬레이션수행시 각 경로들에대한 정보들을 효율적으로 저장하기위한 경로트리를 구성하여 메모리의 낭비를 줄인다. 활성화되는 경로의 로버스트 테스트용이도를 정의하고, 단계적 역추적(stepwise backtracing) 알고리즘을 제안하여 역추적 과정중의 불필요한 계산과정을 줄이고 팬아웃이 많은 회로의 경우에 중복되는 계산과정을 줄임으로서 시뮬레이션 속도를 향상시킨다.