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LTPS TFT 논리회로 성능향상을 위한전류모드 논리게이트의 설계 방법
이준창,정주영 대한전자공학회 2007 電子工學會論文誌-SD (Semiconductor and devices) Vol.44 No.9
Development of high performance LTPS TFTs contributed to open up new SOP technology with various digital circuits integrated in display panels. This work introduces the current mode logic (CML) gate design method with which one can replace slow CMOS logic gates. The CML inverter exhibited small logic swing, fast response with high power consumption. But the power consumption became compatible with CMOS gates at higher clock speed. Due to small current values in CML, layout area is smaller than the CMOS counterpart even though CML uses larger number of devices. CML exhibited higher noise immunity thanks to its non-inverting and inverting outputs. Multi-input NAND/AND and NOR/OR gates were implemented by the same circuit architecture with different input confirugation. Same holds for MUX and XNOR/XOR CML gates. We concluded that the CML gates can be designed with few simple circuits and they can improve power consumption, chip area, and speed of operation. LTPS TFT의 개발과 성능 향상은 패널에 다양한 디지털 회로를 내장하는 SOP의 비약적 발전에 기여하였다. 본 논문에서는 일반적으로 적용되는 낮은 성능의 CMOS 논리게이트를 대체할 수 있는 전류모드 논리(CML) 게이트의 설계 방법을 소개한다. CML 인버터는 낮은 로직스윙, 빠른 응답 특성을 갖도록 설계할 수 있음을 보였으며 높은 소비전력의 단점도 동작 속도가 높아질수록 CMOS의 경우와 근사해졌다. 아울러 전류 구동능력을 키울 필요가 없는 까닭에 많은 수의 소자가 사용되지만 면적은 오히려 감소하는 것을 확인하였다. 특히 비반전 및 반전 출력이 동시에 생성되므로 noise immunity가 우수하다. 다수 입력을 갖는 NAND/AND 및 NOR/OR 게이트는 같은 회로에 입력신호를 바꾸어 구현할 수 있고 MUX와 XNOR/XOR 게이트도 같은 회로를 사용하여 구현할 수 있음을 보였다. 결론적으로 CML 게이트는 다양한 함수를 단순한 몇가지의 회로로 구성할 수 있으며 낮은 소비전력, 적은 면적, 개선된 동작속도 등을 동시에 추구할 수 있는 대안임을 확인하였다.
ROS를 사용하는 2d lidar에서 저가형 3d lidar 구현을 통한 KF 기반 물체 추적 알고리즘
이준창,김관수 제어로봇시스템학회 2021 제어로봇시스템학회 국내학술대회 논문집 Vol.2021 No.6
In this paper, we present and kalman filter (KF) based object tracking algorithm using 3D point cloud data obtained by implementing a low-cost lidar using a 2D lidar. In this paper shows efficient resolution for tracking small and slow objects by implementing a 3D lidar using a servo motor.
System-On-Panel 적용을 위한 저온 폴리 실리콘 박막 트랜지스터 레벨쉬프터 설계
이준창,정주영,Lee, Joon-Chang,Jeong, Ju-Young 대한전자공학회 2006 電子工學會論文誌-SD (Semiconductor and devices) Vol.43 No.2
본 논문에서는 새로운 레벨쉬프터 회로의 구조를 제안한다. 제안된 구조는 높은 입력전압을 필요로 하는 회로에 낮은 입력 전압을 주어도 충분히 동작할 수 있는 능력을 가진다. 기존의 레벨쉬프터 회로에 비해 동작 속도는 비슷하고 전력소모와 회로 면적에 대해서 장점을 갖는다. 마지막으로 HSPICE 시뮬레이션 과정을 통해 제안된 회로의 장점을 실험적으로 증명하였다. We proposed a new level shifter circuit architecture. The prposed circuit can provide high output voltage upto 15V by taking 3.3V logic signal compared to the conventional level shifter. The unposed circuit has compatible speed, low power consumption and chip size. We have confirmed the operation by conducting HSPICE simulation.
김남호,김일남,이준창 江原大學校 産業技術硏究所 1994 産業技術硏究 Vol.14 No.-
The effects of transient inrush currents on the dynamic characteristics of percentage differential relays are studied when the ower transformers are reenergized. An algorithm of estimation the nonlinear magnetic property of power transformer and current trnasformer core are developed. Using this method, we can analyze the effect of inrush currents on the trip region of the percentage differential relays corresponding to the variation of the phase angle and the residual magnetism at the instant of switch closing. Test results are used to verify the availibility of the proposed algorithm. Finally a case study is performed to the 110 MVA main transformer in hydraulic power station.
이양창,이준성 경기대학교 산업기술종합연구소 2004 산업기술종합연구소 논문집 Vol.28 No.-
중수형 원자로의 주요기기인 중수로 압력관은 가동중 검사시간과 장비의 제약으로 표본검사를 수행하고 있다. 국내 원전의 압력관에 대한 가동중 검사결과를 분석하면 검사 대상에서 제외된 압력관에 결함이 존재할 확률이 높아 이를 고려한 건전성평가가 필요하다. 본 연구에서는 이를 위해 확률론적 건전성평가 기법을 도입하였다. 현재 사용중인 압력관 평가절차 및 평가수식들은 모두 결정론적 건전성평가 기법을 바탕으로 작성되어있어 확률론적 해석에 바로 적용할 수 없어 본 연구에서는 파손평가선도에 근거한 압력관의 파손기준을 함께 제시하였다. 이를 활용하여 파손확률을 예측하였으며, 파손평가선도 및 파단전누설개념 적용성을 검토하였다.