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- 저자 : 안태원 (검색결과 111 건)
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멀티프로그래밍 환경에서의 새로운 DRAM 구조의 성능 분석
안태원,정덕균,민상렬,최윤호 대한전자공학회 1994 전자공학회논문지-A Vol.31 No.6
In the design of modern computer systems, the speed gap between the CPUs and DRAMs has been a major concern. To relieve this problem at a low cost, several new DRAM architectures have been proposed. This study is aimed at evaluating quantitatively the impact of the new DRAM architectures (synchronous DRAM. dual-RAS synchronous DRAM, and enhanced DRAM) on the memory system performance. We developed a cache and memory simulator and performed various experiments using the traces generated from four benchmark programs. The simulation results show that the new DRAM architectures offer a better performance than a conventional one by 5~30% in a low cost system and their improvement in a high performance system is less than 1%. However, for resonable multiprogramming workoads, additional performance improvement of about 10~28% is expected in a high performance system while 1~3% in a low cost system.
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유동-구조 연성해석기법을 이용한 풍하중이 관절형 컨테이너 크레인에 미치는 영향에 관한 연구
안태원,이성욱,한동섭,김태형,한근조 한국항해항만학회 2008 한국항해항만학회지 Vol.32 No.2
This study was carried out to the effect of wind load on the structural stability of an articulated type container crane according to the wind direction assuming that 75m/s wind velocity is applied on a container crane using FSI(fluid-structural interaction). To consider fluid phenomenon around the container crane, the wind load was derived by the computation fluid dynamic, and it applied to the FSI which can guarantee an accuracy and a reliability in the design stage for wind resistant structural stability to minimize the damage due to high wind load applied in a container crane with a 'ㄱ' type articulated boom which used in the total height restriction region. Following from this, the reaction force on the each support of a container crane was suggested. ANSYS ICEM CFD 10.0 and ANSYS CFX 10.0 used for computation fluid dynamic, and the ANSYS Workbench 11.0 was used for the fluid-structural interaction. 컨테이너 크레인의 설계 시 적용되는 하중 조건 중에서 풍하중이 가장 중요하게 고려되어지는바, 본 연구는 75m/s의 풍하중이 컨테이너 크레인에 작용 할 때 컨테이너 크레인의 구조적 안정성에 미치는 영향을 보다 정확하게 예측하기 위하여 유동-구조 연성해석을 실시하였다. 컨테이너 크레인에 작용하는 실제 유동현상을 고려하기 위하여 먼저 전산유동해석을 실시하였으며, 이를 통해서 얻어진 풍하중을 구조해석의 하중조건으로 적용하는 유동-구조 연성해석을 통하여 컨테이너 크레인 각 지지점에서의 반력을 도출하고 그 결과를 분석하였다. 사용된 모델은 주변 환경으로 인하여 컨테이너 크레인의 최대 고도가 제한 될 경우 사용되는 관절형 컨테이너 크레인이며 전산유동해석 및 유동-구조 연성해석 프로그램으로는 ANSYS ICEM CFD 10.0과 ANSYS CFX 10.0을 사용하였다.
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안태원 한국비파괴검사학회 2000 한국비파괴검사학회지 Vol.20 No.2
전기-기계 상호관계식을 사용하여 시편에서의 산란파를 탐촉자의 전기 신호로 변환시키는 방법을 다루었다. 산란파에 의한 탐촉자의 전기 신호는 입사파와 산란파의 변위, 응력 관계식의 적분으로 표시되었다. 적분 표면은 산란자를 포함하는 닫힌 표면이면 입사파와 산란파의 변위, 응력도 이 표면 좌표에서의 값을 사용한다. 파동해석 결과에서 구한 산란된 파동으로부터 초음파 현미경의 탐촉자 전기 신호를 구했으며 계산 결과를 실험 결과와 비교하였다. The electromechanical reciprocity identity is introduced to relate the voltage at the terminals of a transducer to the acoustic wavefields scattered from the specimen. The voltage at the terminals of the transducer is expressed as an integral equation in terms of the displacement and stress of the incident and scattered waves on the closed surface enclosing the scatterer. The equation is used to relate the voltage at the terminals of an acoustic microscope's transducer to the acoustic wavefields at the interface between the specimen and the coupling fluid. The voltage calculated using the integral equation is compared with the experimental result.
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Design of CMOS LC VCO with Fast AFC Technique for IEEE 802.11a/b/g Wireless LANs
안태원,윤찬근,문용,Ahn Tae-Won,Yoon Chan-Geun,Moon Yong The Institute of Electronics and Information Engin 2006 電子工學會論文誌-CI (Computer and Information) Vol.43 No.9
본 논문에서는 IEEE 802.11a/b/g 무선 랜을 위하여 고속 AFC 기법이 적용된 CMOS LC VCO의 설계를 다룬다. 1.8V $0.18{\mu}m$ CMOS 공정을 사용하였으며, 현재 국제적으로 표준화가 진행된 모든 무선 랜 응용에 적합하도록 인덕터 및 캐패시터를 스위칭하는 방법으로 5.8GHz 대역, 5.2GHz 대역 및 2.4GHz 대역에서 동작하도록 설계하였다. 또한 주파수-전압 특성을 선형화하기 위하여 최적화된 버랙터 바이어싱 기법을 사용하였으며, 필요로 하는 모든 대역에서 저잡음 특성을 유지하기 위하여 4비트 캐패시터 뱅크를 사용하고, 광대역 디지털 주파수 검출기를 이용한 고속 AFC 기법을 구현하여 그 동작을 확인하였다. CMOS LC VCO with fast response adaptive frequency calibration (AFC) technique for IEEE 802.11a/b/g WLANs is designed in 1.8V $0.18{\mu}m$ CMOS process. The possible operation is verified for 5.8GHz band, 5.2GHz band, and 2.4GHz band using the switchable L-C resonators. To linearize its frequency-voltage gain (Kvco), optimized multiple MOS varactor biasing tecknique is used. In order to operate in each band frequency range with reduced VCO gain, 4-bit digitally controlled switched- capacitor bank is used and a wide-range digital logic quadricorrelator (WDLQ) is implemented for fast frequency detector.
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IEEE 802.11a/b/g 무선 랜을 위한 고속 AFC 기법의 CMOS LC VCO의 설계
안태원,문용,윤찬근 대한전자공학회 2006 電子工學會論文誌-SD (Semiconductor and devices) Vol.43 No.9
CMOS LC VCO with fast response adaptive frequency calibration (AFC) technique for IEEE 802.11a/b/g WLANs is designed in 1.8V 0.18μm CMOS process. The possible operation is verified for 5.8GHz band, 5.2GHz band, and 2.4GHz band using the switchable L-C resonators. To linearize its frequency-voltage gain (Kvco), optimized multiple MOS varactor biasing technique is used. In order to operate in each band frequency range with reduced VCO gain, 4-bit digitally controlled switched- capacitor bank is used and a wide-range digital logic quadricorrelator (WDLQ) is implemented for fast frequency detector. 본 논문에서는 IEEE 802.11a/b/g 무선 랜을 위하여 고속 AFC 기법이 적용된 CMOS LC VCO의 설계를 다룬다. 1.8V 0.18μm CMOS 공정을 사용하였으며, 현재 국제적으로 표준화가 진행된 모든 무선 랜 응용에 적합하도록 인덕터 및 캐패시터를 스위칭하는 방법으로 5.8GHz 대역, 5.2GHz 대역 및 2.4GHz 대역에서 동작하도록 설계하였다. 또한 주파수-전압 특성을 선형화하기 위하여 최적화된 버랙터 바이어싱 기법을 사용하였으며, 필요로 하는 모든 대역에서 저잡음 특성을 유지하기 위하여 4비트 캐패시터 뱅크를 사용하고, 광대역 디지털 주파수 검출기를 이용한 고속 AFC 기법을 구현하여 그 동작을 확인하였다.
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분수형 주파수 합성기를 위한 3비트 4차 시그마-델타 변조기의 설계
안태원,이원석 대한전자공학회 2004 電子工學會論文誌 IE (Industry electronics) Vol.41 No.01
The frequency step size of fractional-N frequency synthesizers can be a fraction of the reference frequency. This makes it possible to achieve low phase noise and fast locking speed. In this paper, optimization method of sigma-delta noise shaper for fractional-N frequency synthesizers has been introduced. The proposed noise shaper is composed of the 4th-order single stage sigma-delta modulator for phase noise shaping, and a 3bit quantizer architecture to improve stability problem as well as to widen the input range. The analytic sigma-delta noise shaper design procedure provided in this paper was verified with Matlab simulation and implemented with VHDL in Altera MAX+PLUS-II environment. 분수형 주파수 합성기는 기준 주파수의 분수배에 해당하는 주파수를 생성하는 것으로서 현재의 이동통신 시스템에서 요구하는 저잡음 및 고속의 주파수 합성을 가능하게 한다. 이 논문에서는 분수형 주파수 합성기를 위한 3비트 4차 시그마-델타 변조기의 최적 설계 기법에 대하여 기술한다. 제시된 설계는 위상 잡음 형성을 위하여 4차의 일렬 구조 시그마-델타 변조기를 사용하였고, 안정성을 높이기 위하여 3비트 양자화기를 사용하였다. 기술된 시그마-델타 변조기의 설계 절차는 Matlab 모의실험에 의하여 이론적인 모델을 검증하였고, Altera MAX+PLUS-II 환경에서 VHDL을 이용하여 구현하여 적용 가능성을 제시하였다.
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