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이길환(Kil-Whan Lee),박기호(Gi-Ho Park),한탁돈(Tack-Don Han),김신덕(Shin-Dug Kim) 한국정보과학회 1998 한국정보과학회 학술발표논문집 Vol.25 No.1A
본 논문에서는 듀얼 데이터 캐쉬(Dual Data Cache)를 위한 효율적인 선택 기법을 제안한다. 듀얼 데이터 캐쉬는 두 개의 지역성을 반영하기 위하여 제안된 구조이다. 이러한 캐쉬의 성능은 참조 실패 시에 참조 실패된 블록을 어떤 캐쉬로 적재할 것인지에 대한 선택 기법에 의해 결정된다. 이러한 선택 기법에 있어서 어떤 참조가 공간적 지역성(spatial locality)이 큰지 아니면 시간적 지역성(temporal locality)이 큰지를 효율적으로 예측하는 것이 중요하다. 본 논문에서는 이러한 지역성을 좀 더 효율적으로 예측하기 위해서는 공간적 지역성 체크 테이블(spatial locality checking table, SLCT)을 이용한 새로운 적응 선택 기법을 제안하였다. 공간적 지역성 체크 테이블은 공간적 지역성을 좀 더 효율적으로 예측하기 위하여 사용되었다. 성능 평가를 위하여 트레이스 구동 시뮬레이션을 수행하였으며, 블록 크기가 큰 캐쉬가 기존의 캐쉬 블록 크기보다 큰 경우에는 평균 메모리 접근시간이 같은 크기의 기존 캐쉬보다 10%에서 50%의 성능 향상이 있음을 확인하였다.
David II: 효과적인 메모리 시스템을 가지는 병렬 렌더링 프로세서
이길환 ( Kil-whan Lee ),박우찬 ( Woo-chan Park ),김일산 ( Il-san Kim ),한탁돈 ( Tack-don Han ) 한국정보처리학회 2004 한국정보처리학회 학술대회논문집 Vol.11 No.1
Current rendering processors are organized mainly to process a triangle as fast as possible and recently parallel 3D rendering processors, which can process multiple triangles in parallel with multiple rasterizers, begin to appear. For high performance in processing triangles, it is desirable for each rasterizer have its own local pixel cache. However, the consistency problem may occur in accessing the data at the same address simultaneously by more than one rasterizer. In this paper, we propose a parallel rendering processor architecture, called DAVID II, resolving such consistency problem effectively. Moreover, the proposed architecture reduces the latency due to a pixel cache miss significantly. The experimental results show that DAVID II achieves almost linear speedup at best case even in sixteen rasterizers.
깊이 검사 결과에 의한 선택적 적재 방법을 가지는 픽셀 캐쉬 구조
이길환(Kil-Whan Lee),박우찬(Woo-Chan Park),김일산(Il-San Kim),한탁돈(Tack-Don Han) 한국정보과학회 2003 정보과학회논문지 : 시스템 및 이론 Vol.30 No.9·10
최근 대부분의 3차원 그래픽 렌더링 프로세서는 메모리 접근 지연 및 대역폭을 줄이기 위해 깊이 데이타와 색상 데이타를 가지고 있는 픽셀 캐쉬(pixel cache)를 사용한다. 본 논문에서는 렌더링 프로세서의 성능을 향상시키기 위한 효과적인 픽셀 캐쉬 구조를 제시한다. 제안하는 픽셀 캐쉬 시스템은 기본적으로 3차원 렌더링 프로세서에서 수행되는 깊이 검사(Z-test) 결과에 의해 선택적으로 깊이 데이타를 캐쉬에 저장하며, 색상 데이타는 별도의 버퍼에 저장한다. 시뮬레이션 결과에 의하면 16K바이트의 제안하는 캐쉬 시스템이 32K바이트의 일반적인 캐쉬보다 더 나은 성능을 보인다. Recently most of 3D graphics rendering processors have the pixel cache storing depth data and color data to reduce the memory latency and the bandwidth requirement.In this paper, we propose the effective pixel cache for improving the performance of a rendering processor. The proposed cache system stores the depth data selectively based on the result of Z-test and the color data are stored into the auxiliary buffer. Simulation results show that the 16Kbyte proposed cache system provides better performance than the 32Kbyte conventional cache.
이재혁(Jaehyuk Lee),박기호(Gi-Ho Park),이길환(Kil-Whan Lee),한탁돈(Tacl-Dom Han) 한국정보과학회 1999 한국정보과학회 학술발표논문집 Vol.26 No.2Ⅲ
미세 회로 기술의 발전은 단일 칩에 집적될 수 있는 트랜지스터의 수를 지속적으로 증가시키고 있으며 이에 따라 복잡도 영시 크게 증가하고 있다. 이러한 설계 복잡도의 증가는 여러 기능 블록이 IP(Intellectual Property) 형태로 독립적으로 설계되어서 이들의 조합으로 새로운 시스템을 구성하는 시스템 온 칩(System On a Chip)과 같은 새로운 시스템 설계 방법에 대한 요구를 증가시키고 있다[1]. 이런 시스템 온 칩에 사용될 메모리 시스템 역시 기존의 표준화된 메인 메모리 이 외에 각각의 다양한 응용에 적합한 맞춤형(Application Specific Standard Products) 내장 메모리 시스템 구조에 대한 필요성이 대두되고 있다. 이와 같이 특정 응용에 적합한 메모리 시스템을 설계하기 위해서는 해당 응용 프로그램의 메모리 참조 패턴을 분석하고 특성화하여 이에 적합한 메모리 시스템을 설계할 수 있는 기본 정보를 제공해 주는 것이 필수적이다. 또한 이러한 정보에 따라 설계된 메모리 시스템에 대한 성능 평가할 환경도 함께 요구된다. 본 연구에서는 다양한 응용의 메모리 참조 특성을 분석하고 특성화하기 위하여 캐쉬 파라메터의 변화에 따른 캐쉬 접근 실패의 분포, 메모리 접근 영역의 분포, 참조 사이에 있는 유일한 참조의 수의 분포 등 다양한 정보를 제공해 주는 환경을 구축하였다.
윤형민(Yoon Hyung Min),박기호(Park Gi Ho),이길환(Lee Kil Whan),한탁돈(Han Tack Don),김신덕(Kim Shin Dug),양성봉(Yang Sung Bong),이용석(Lee Yong Surk) 한국정보처리학회 1998 정보처리학회논문지 Vol.5 No.3
Trace-driven simulation is widely used method to evaluate the performance of the cache memory systems. The accuracy of trace-driven simulation highly depends on the length of the traces and the information contained in the traces. Various methods are used to generate the accurate traces. Among these methods, hardwaer monitoring technique generates the traces which have more information than others. The traces obtained by hardware monitoring technique, have much information such as about context switch, OS references, and timing of memory reference. However, hardware monitoring system has a drawback that it is difficult to be modified to get the traces from various systems. In this paper, a hardware monitoring system is designed using the EPLD(Erasable Programmable Logic Device)s to alleviate the drawback and easy to get the traces from various systems. The designed hardware monitoring system can be operated with high clock frequency up to 66Mhz.
만성요독증에서 적혈구막 Na+ - K+ ATPase 활성도에 대한 혈액투석의 효과
윤영석(Young Suk Yoon),양철우(Chul Woo Yang),조현미(Hyun Mi Cho),이길환(Kil Whan Lee),손현식(Hyun Sik Son),전영수(Young Soo Chun),최규보(Kyu Bo Choi),방병기(Byung Kee Bang),조규철(Kyu Chul Cho) 대한내과학회 1986 대한내과학회지 Vol.31 No.1
N/A To study the effects of hemodialysis on erythrocyte membrane Na+-K+ ATPase activity, we measured cytochemical Na+-K+ ATPase activity of erythrocyte in 36 patients with chronic uremia. The results were summarized as follows: 1) The Na+-K+ ATPase activity in the predialytic subjects was lower than that of normal controls(P=0), however value in the post-dialytic subjects was greater than that of normal controls(P<0.05). Also the value of postdialytic subjects increased significantly than that of predialytic subjects(P<0.001). 2) When an erythrocyte membrane taken from normal human was incubated with supernatantes of boiled plasma from predialytic individuals, the Na+-K+ ATPase activity of erythrocyte membrane was significantly lower than that of normal control(P<0.01). However, not significant difference between normal control and postdialytic subjects was seen. 3) The percent inhibition of Na+-K+ ATPase in the predialytic individuals was significantly higher than that of postdialytic individuals; the median value of inhibition in the predialytic group was 52.4%(range; -15.5~77.5%) and that of postdialytic group was -15.5%(range; -130.9~38.4%) (P<0.001). Based on the above findings, it is suggested that the hemodialyiss may acutely affect the erythrocyte sodium pump, possibly through the modulation of a dialyzable ouabain-like factor triggered by the extracellular volume change and removal of uremic toxin.
3차원 그래픽 래스터라이제이션에서의 텍스쳐 / 픽셀 캐쉬 성능분석
김일산(Il-San Kim),박기호(Gi-Ho Park),이길환(Kil-Whan Lee),박우찬(Woo-Chan Park),한탁돈(Tack-Don Han) 한국정보과학회 2002 한국정보과학회 학술발표논문집 Vol.29 No.1A
본 논문에서는 3차원 그래픽의 래스터라이제이션 단계에서 발생하는 메모리 트래픽 문제를 해결하기 위해 사용되는 텍스쳐 및 픽셀 캐쉬에 대한 성능을 분석하였다. 이를 위해 화면의 해상도, 컬러 정보, 깊이 정보 및 캐쉬 구성의 변화에 따른 이들 캐쉬의 성능변화를 살펴보았으며 실험결과 텍스처 캐쉬와 픽셀 캐쉬의 설계 시의 블록 크기의 의한 영향의 매우 중요함을 알 수 있었다. 특히 픽셀 캐쉬의 경우에는 시간적 지역성은 거의 없으며 매우 큰 공간적 지역성을 보이므로 이를 잘 반영할 수 있는 캐쉬 구조가 필요하다.