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소현호,김진상,조원경,김영수,서덕영,So Hyeon-Ho,Kim Jinsang,Cho Won-Kyung,Kim Young-Soo,Suh Doug Young 한국통신학회 2005 韓國通信學會論文誌 Vol.30 No.12C
본 논문에서는 곱셈을 수행할 때 발생되는 스위칭 율을 줄이는 방식의 저전력 부스 곱셈기를 제안한다. radix-4 부스 알고리즘 (radix-4 Booth algorithm)은 입력에서 연속되는 3비트가 0이나 1의 같은 값을 가지게 되면, 부스 인코딩 결과로서 0을 발생시키는 특성을 가지고 있다. 따라서 곱셈기의 두 입력 중 더 작은 활성영역을 갖는 입력을 승수로 사용할 때 부분 곱셈결과가 0이 될 확률이 높다. 제안된 곱셈기는 곱셈식을 본래의 곱셈 입력 비트보다 더 작은 비트를 갖는 여러 게의 곱셈식으로 분할한 후, 각각의 곱셈들을 독립적으로 계산하여 각각의 곱셈의 결과를 더하여 최종적인 결과를 얻는다. 따라서 곱셈의 두 입력간의 교환율은 기존의 곱셈기보다 더 높아지게 된다. 이는 제안된 곱셈기의 부스 인코딩 결과가 0이 되는 확률이 기존의 곱셈기보다 더 높은 저전력 곱셈기를 구현할 수 있음을 의미한다. 제안된 곱셈기는 기존의 부스 곱셈기보다 최대 $20\%$ 정도의 소모전력이 감소됨을 확인하였다. In this paper, we propose a low-power Booth multiplication which reduces the switching activities of partial products during multiplication process. Radix-4 Booth algorithm has a characteristic that produces the Booth encoded products with zero when input data have sequentially equal values (0 or 1). Therefore, partial products have higher chances of being zero when an input with a smaller effective dynamic range of two multiplication inputs is used as a multiplier data instead of a multiplicand. The proposed multiplier divides a multiplication expression into several multiplication expressions with smaller bits than those of an original input data, and each multiplication is computed independently for the Booth encoding. Finally, the results of each multiplication are added. This means that the proposed multiplier has a higher chance to have zero encoded products so that we can implement a low power multiplier with the smaller switching activity. Implementation results show the proposed multiplier can save maximally about $20\%$ power dissipation than a previous Booth multiplier.
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인접한 블록의 움직임 벡터의 방향성을 이용한 고속 움직임 추정 알고리즘
소현호,김진상,조원경 경희-다반 ASIC 설계교육센터 2003 경희-다반 ASIC센터 논문집 Vol.4 No.-
본 논문에서는 현재 블록의 이웃한 블록들의 움직임 벡터(motion vector, MV)와 움직임 벡터들의 방향성을 고려하여 현재 블록의 움직임 벡터를 예측하여 후보 블록의 개수를 줄여 계산 속도를 빠르게 하는 블록 매칭움직임 추정 알고리즘을 제안한다. 제안된 알고리즘은 다이아몬드 패턴(Diamond Search)을 수정하여 방향성과벡터의 크기를 고려하여 패턴의 간격과 방향등을 결정하여 움직임 벡터의 후보들을 결정한다. 제안된 알고리즘은 다른 다양한 검색방법들과 비교하여 더 적은 계산량을 갖으면서 비슷한 성능을 보여준다.
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문지경,소현호,김진상,조원경 경희-다반 ASIC 설계교육센터 2003 경희-다반 ASIC센터 논문집 Vol.4 No.-
Many full searchblock matching (FSBM) architectures have been proposed for the motion estimation. However, the FSBM architectures need many computations and a lot of external memory accesses which are the main source of the power consumption. We propose an efficient low-power architecture for the full search block matching (FSBM) motion estimation by eliminating unnecessary computations and data reuse. Implementation results show the proposed motion estimator can save maximally about 9.3% power dissipation than a previous motion estimator.
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