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- 저자 : 이왕용(Wang-Yong Lee) (검색결과 8 건)
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클록 보정회로를 가진 1V 1.6-GS/s 6-bit Flash ADC
김상훈,홍상근,이한열,박원기,이왕용,이성철,장영찬,Kim, Sang-Hun,Hong, Sang-Geun,Lee, Han-Yeol,Park, Won-Ki,Lee, Wang-Yong,Lee, Sung-Chul,Jang, Young-Chan 한국정보통신학회 2012 한국정보통신학회논문지 Vol.16 No.9
A 1V 1.6-GS/s 6-bit flash analog-to-digital converter (ADC) with a clock calibration circuit is proposed. A single track/hold circuit with a bootstrapped analog switch is used as an input stage with a supply voltage of 1V for the high speed operation. Two preamplifier-arrays and each comparator composed of two-stage are implemented for the reduction of analog noises and high speed operation. The clock calibration circuit in the proposed flash ADC improves the dynamic performance of the entire flash ADC by optimizing the duty cycle and phase of the clock. It adjusts the reset and evaluation time of the clock for the comparator by controlling the duty cycle of the clock. The proposed 1.6-GS/s 6-bit flash ADC is fabricated in a 1V 90nm 1-poly 9-metal CMOS process. The measured SNDR is 32.8 dB for a 800 MHz analog input signal. The measured DNL and INL are +0.38/-0.37 LSB, +0.64/-0.64 LSB, respectively. The power consumption and chip area are $800{\times}500{\mu}m2$ and 193.02mW. 클록 보정회로를 가진 1V 1.6-GS/s 6-비트 flash 아날로그-디지털 변환기 (ADC: analog-to-digital converter)가 제안된다. 1V의 저전압에서 고속 동작의 입력단을 위해 bootstrapped 아날로그 스위치를 사용하는 단일 track/hold 회로가 사용되며, 아날로그 노이즈의 감소와 고속의 동작을 위해 평균화 기법이 적용된 두 단의 프리앰프와 두 단의 비교기가 이용된다. 제안하는 flash ADC는 클록 보정회로에 의해 클록 duty cycle과 phase를 최적화함으로 flash ADC의 동적특성을 개선한다. 클록 보정 회로는 비교기를 위한 클록의 duty cycle을 제어하여 evaluation과 reset 시간을 최적화한다. 제안된 1.6-GS/s 6-비트 flash ADC는 1V 90nm의 1-poly 9-metal CMOS 공정에서 제작되었다. Nyquist sampling rate인 800 MHz의 아날로그 입력신호에 대해 측정된 SNDR은 32.8 dB이며, DNL과 INL은 각각 +0.38/-0.37 LSB, +0.64/-0.64 LSB이다. 구현된 flash ADC의 면적과 전력소모는 각각 $800{\times}500{\mu}m2$와 193.02 mW 이다.
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위상 샘플링 방식 DRFM 적용 대역폭 제어 잡음 재밍 기법 개발
홍상근(Sang-Geun Hong),이왕용(Wang-Yong Lee),류정호(Jeong-Ho Ryu),신욱현(Wook-Hyen Shin) 한국전자파학회 2011 한국전자파학회논문지 Vol.22 No.8
현대 전쟁에서는 직접 적을 타격하여 파괴하는 것뿐만 아니라 적의 전투 능력을 무력화하는 재밍의 중요성이 증가하고 있다. 잡음 재밍은 전자전 재밍 기법의 기본이 되는 기법으로 재밍하고자 하는 장비의 수신기 특성에 영향을 적게 받으며, 거의 모든 수신 장치를 교란할 수 있는 방식이다. 잡음 재밍의 경우, 출력 대비 효율을 높이기 위해 적 수신기의 대역폭과 잡음의 대역폭을 일치시킬 필요가 있으며, 다수의 서로 다른 레이더 표적을 시분할하여 재밍하기 위해 고속으로 잡음 대역폭을 가변할 필요가 있다. 본 논문은 위상 샘플링 방식으로 운용되는 DRFM에 적용할 수 있는 실시간으로 잡음 대역폭 제어가 가능한 재밍 기법을 시뮬레이션을 통해 개발하여 제안한다. In modern warfare, jamming for neutralizing the enemy electronic equipments is as important as destroying them by common weapon systems. Noise jamming is a base technique of EA(Electronic Attack) and it is one of the effective jamming techniques. Noise jamming is effective regardless of enemy electronic equipment receiver types. For increasing jamming efficiency using the same output power, noise jamming bandwidth has to be similar to target receiver’s bandwidth. Radar jamming source like DRFM(Digital Radio Frequency Memory) requires noise bandwidth changing immediately for time sharing multiple jamming. In this paper, we developed bandwidth changable noise jamming signal for phase sampling type DRFM and do simulation using Matlab for showing the jamming signal output.
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위상 샘플방식 DRFM에 적용 가능한 VGPO/I 재밍기법 기술 구현
최영익(Young-Ik Choi),홍상근(Sang-Guen Hong),이왕용(Wang-Yong Lee),박진태(Jin-tae Park),이창훈(Chang-hoon Lee) 한국전자파학회 2016 한국전자파학회논문지 Vol.27 No.12
현대전에서는 각종 추적 레이다를 이용하여 표적의 위치 추적이 이루어진다. 따라서 적군 레이다를 교란하여 아군위치 정보 추적을 무력화하는 전자공격인 레이다 재밍 기술의 중요성이 증가하고 있다. 레이다 재밍 기법 중 VGPO/I는 전자전 레이다 재밍 기법의 기본이 되는 기법 중 하나이며, 주로 신호의 펄스 도플러 효과를 이용하여 위치를 추적하는 레이다 대상 재밍 기법 운용이 가능하다. 본 논문은 위상 샘플방식으로 운용되는 DRFM에 적용할 수 있는 위상정보를 이용한 VGPO/I 재밍 기법 기술구현방식을 제안하고, 시뮬레이션을 통해 검증하였다. In modern warfare, various target tracking radars are used for target location tracking. So, the importance of EA radar jamming technique which disrupt enemy target tracking radar in oder to neutralize tararget location tracking has increased. VGPO/I jamming is a base technique of EA(Electronic Attack), it is possible to operate to pulse-Doppler radar. In this papar, we develop VGPO/I jamming technique that can apply to phase sampled DRFM by using phase information and verifiy through simulations.
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FPGA의 DDS Core를 이용한 다중 톤 재밍 신호 생성
홍상근(Sang-Geun Hong),곽창민(Chang-Min Kwak),이왕용(Wang-Yong Lee) 한국전자파학회 2011 한국전자파학회논문지 Vol.22 No.9
전쟁에서 통신은 매우 중요하다. 과거에는 전령을 이용하였으나 현대전에서는 통신기기의 발달로 주로 무선통신망을 이용하고 있다. 현대전에서 적 전력을 약화시키기 위해 재밍 신호를 이용하여 적 통신망의 교란을 시도한다. 통신망을 교란하는 통신 재밍 신호로 흔하게 사용되는 것 중 톤 재밍 신호가 있다. 톤 재밍은 한 개 또는 여러 개의 톤을 주파수 스펙트럼 상에 출력하는 방법으로 적 무선 통신기의 수신단을 무력화 하는 기법이다. 본 논문에서는 Xilinx사에서 제공하는 FPGA(Field Programmable Gate Arry)와 DDS(Direct Digital Synthesizer) core를 사용하여 최대 10개의 톤을 생성하였으며, 생성된 톤의 간격과 개수를 제어하는 방안을 제시하고, 실제로 실험한 결과를 기술하였다. Communication is very important in warfare. Dispatch riders were used in ancient warfare, but communication system is used in modern warfare, as the advancement of communication equipments. In order to weaken enemy military strength, communication jamming signal disrupts enemy communication systems. Tone jamming is one of the common communication jamming techniques. Tone jamming is that several tones are placed in the spectrum for neutralizing the enemy's radio communication receivers. In this paper, we develop multitone jamming signal controlled tone number up to 10 tones and tone interval between tones using DDS(Direct Digital Synthesizer) core and FPGA(Field Programmable Gate Arry) of Xilinx Inc. and show the jamming signal output.
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GaN HEMT를 이용한 광대역 80 W급 반도체 전력증폭기 설계
김재덕(Jae Duk Kim),김보균(Bo Gyun Kim),유승학(Seung Hak Yoo),이기욱(Ki Wook Lee),이문석(Moon Seok Lee),이왕용(Wang Yong Lee) 한국전자파학회 2020 한국전자파학회논문지 Vol.31 No.9
본 논문에서는 GaN HEMT(gallium nitride high electron mobility transistor)를 이용한 광대역(S to C band) 80 W급 전력증폭기 설계 및 제작과 측정결과를 기술하였다. 제안된 광대역 80 W급 전력증폭기는 입력된 단일 RF 신호를 2개의 경로로 분배하고, 각각의 신호는 GaN HEMT Bare Die에서 증폭된 후 다시 전력결합 되는 평형 결합구조의 광대역 임피던스 매칭 기법을 적용하였다. 설계된 전력증폭기는 높은 열전도도의 Super CMC(S-CMC) 캐리어에 유테틱 본딩(eutectic bonding) 공정으로 패키징하여 80 W급 성능을 확보하였다. 제작된 광대역 80 W 전력증폭기 측정결과, 동작 주파수 전대역에서 42 dBm CW 입력 시에 평균 출력 81.4 W, 평균 전력부가효율(PAE) 36.65 %, 평균 전력 이득 7.1 dB 특성을 가진다. 또한, 4.5 GHz 주파수에서 41 dBm CW 입력 RF 신호 주입 시 최대출력 121.9 W, 최대 PAE 49.16 %, 최대 전력 이득 9.86 dB 특성을 가지는 것을 확인하였다. 전자전용 고출력 재밍 송신장치(전자전 재머, electronic warfare jammer) 적용가능성을 검증하기 위해, 두 개의 광대역 80 W급 증폭기를 90° 하이브리드 커플링 전력결합구조로 120 W급 RF SSPA 모듈을 구현하고 측정하였다. This paper describes the design & fabrication and measurement results of a wide band(S to C band) 80 W solid state power amplifier(SSPA) using a GaN HEMT. The SSPA is fabricated with wide band impedance matching topology in a balanced combined configuration using two GaN HEMT bare dies and with a super CMC(S-CMC) structure with high thermal conductivity using the eutectic bonding carrier packaging method. The wide band 80 W SSPA, with 42 dBm CW input power injection at operation frequency, demonstrated performance with an average output power of 81.4 W, an average power addition efficiency(PAE) of 36.65%, and an average power gain of 7.1 dB. Furthermore, with 41 dBm CW input power injection at 4.5 GHz frequency, it had a peak output power of 121.9 W, a maximum PAE of 49.16 %, and a maximum power gain of 9.86 dB. To verify the applicability to an electronic warfare jammer, the designed 120 W RF SSPA module was implemented and measured by combining two such wide band 80 W SSPAs in a 90° hybrid coupled power configuration.
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