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홍대기(Daeki Hong),이형철(Hyeongcheol Lee),곽재호(Jaeho Kwak) 한국자동차공학회 2007 한국자동차공학회 춘 추계 학술대회 논문집 Vol.- No.-
This paper presents a mathematical model and simulation program of a train with regenerative braking system by using Matlab/Simulink in the energy generation, consumption and transfer point of view. This paper also determines the specifications of each component of the train by using the developed program. The train model and simulation program consist of the speed profile of the train, longitudinal dynamics of the train, wheel dynamics with brake system, and electric system such as the motor/generator and the energy storage sytsem. This paper also provides observation of the energy consumption and regeneration ratios of the energy storage equipped train. The simulation results are compared with the test results to verify the simulation program.
RS(23,17) 복호기를 위한 PS-DCME 알고리즘
강성진 ( Sungjin Kang ),홍대기 ( Daeki Hong ) 한국인터넷정보학회 2009 인터넷정보학회논문지 Vol.10 No.1
본 논문에서는 MB-OFDM 시스템에서 사용되는 RS(23,17)부호의 복호기에 사용될 수 있는 PS-DCME(Pipeline Structured-Degree Computationless Modified Euclidean) 알고리즘을 제안한다. 제안된 PS-DCME 알고리즘은 다항식의 차수 계산과 차수 비교를 하지 않고 상태(state) 변화만을 이용하여 ME 알고리즘을 수행하기 때문에, 복호기의 하드웨어 복잡도를 줄일 수 있으며, 고속의 RS(Reed-Solomon) 복호기를 구현할 수 있다. Verilog HDL을 사용하여 알고리즘을 구현하였고, 삼성 65nm library를 이용하여 합성한 결과, 400MHz(2.5nsec)에서 timing closure되었기 때문에, 실제 ASIC을 제작했을 경우에 250MHz정도까지는 동작이 보장된다고 볼 수 있으며, gate count는 19,827이다. In this paper, A pipeline structured-degree computationless modified Euclidean (PS-DCME) algorithm is proposed, which can be used for a RS(23,17) decoder for MB-OFDM system. PS-DCME algorithm requires a state machine instead of the degree computation and comparison circuits, so that the hardware complexity of the decoder can be reduced and high-speed decoder can be implemented. We have implemented a RS(23,17) decoder with PS-DCME using Verilog HDL and synthesized with Samsung 65nm library. From synthesis results, it can operate at clock frequency of 250MHz, and gate count is 19,827.