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건설현장 장년 근로자의 안전보건 실태조사 및 재해감소 방안에 관한 연구
김판기,방성덕,김경석,김형관,Kim, Panki,Bang, Seongdeok,Kim, Kyeongseok,Kim, Hyoungkwan 한국건설관리학회 2017 한국건설관리학회 논문집 Vol.18 No.1
대한민국 총 인구에서 50세 이상 준고령자가 차지하는 비율은 2010년 29.2%에서 2015년 34.8%로 증가하였다. 이에 따라 전체 건설근로자 대비 50세 이상 건설근로자의 비율은 2010년 20.1%에서 2015년 27.0%로 증가하였다. 이러한 노령화 시대에 맞추어 건설업계에서는 장년근로자들에 대한 재해예방대책을 주어진 사업목표, 예산집행 등을 절차에 맞게 충실히 수행해왔으나 근본적인 재해예방에 한계가 있었다. 이는 건설재해예방의 대책들이 아직까지 장년근로자보다는 전 연령을 고려하고 있기 때문이라 판단된다. 본 연구에서는 건설현장에서의 장년근로자의 안전보건실태를 조사하고 재해감소방안을 제시하였다. 특히 급격히 증가되고 있는 장년근로자의 재해를 감소시키기 위하여 관련문헌 및 안전규정과 산업재해원인통계, 산업재해현황통계 등을 고찰하고, 전국 건설현장에서 공사활동에 직접 참여하고 있는 근로자 3,549명을 대상으로 한 설문조사를 통해 안전보건 실태를 조사, 그간의 재해예방사업 추진현황 및 문제점 분석 등을 통한 재해감소 종합대책을 제시하였다. 본 논문에서 제시한 대책을 실제 정책에 반영할 수 있다면 점진적으로 증가추세인 건설현장에서의 장년근로자 재해를 줄일 수 있을 것으로 기대된다. The proportion of elderly people over 50 years old in the total population of Korea increased from 29.2% in 2010 to 34.8% in 2015. As a result, the proportion of construction workers over 50 years old compared to the total construction workers increased from 20.1% in 2010 to 27.0% in 2015. In this aging society, the construction industry has faithfully carried out the business objectives and budget execution of measures to prevent disasters against elderly workers, but there was a limit to the fundamental prevention of disasters. Because the countermeasures for the prevention of construction disaster are considered on all ages rather than elderly workers. This study investigates the safety and health status of elderly workers at construction sites and suggests the plans to reduce disaster. In particular, to reduce disasters of rapidly growing elderly workers, the authors reviewed the related literature and safety regulations, statistics on the causes of industrial accidents, statistics on the status of industrial accidents, and applied to 3,549 workers who participated directly in the construction activities. The authors surveyed the actual situation of safety and health, presented the comprehensive disaster reduction measures by analyzing the current status and problems of disaster prevention projects. If the countermeasures proposed in this paper can be reflected in the actual policy, it is expected that the countermeasures will be possible to reduce the disaster of the elderly workers at the construction site, which is gradually increasing.
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김판기(Panki Kim),이형표(Hyoungpyo Lee),김현필(Hyunpil Kim),전호윤(Hoyoon Jun),이용석(Yongsurk Lee) 한국정보과학회 2007 정보과학회논문지 : 시스템 및 이론 Vol.34 No.11·12
Field-Programmable Gate Arrays는 사용자가 프로그램이 가능한 혁신적인 대규모 집적 회로이며 값싸고 빠르게 주문자가 원하는 VLSI 구현할 수 있는 장점을 가지고 있다. 그러나 특정 목적의 프로그램의 속도가 증가했을 때 FPGA가 연산하는 동안의 전력 소모와 연결선의 지연이 FPGA를 프로그램 하는데 중요한 문제점이 된다. 특히 기존 구조에서 사용되는 내부연결선이 전체 FPGA의 전력 중 65%를 소모한다. 이로 인하여 내부연결선이 전력 소모에 큰 영향을 주기 때문에 배선 시 연결선의 길이와 블록 간의 연결선을 줄임으로써 전력 소모를 줄일 수 있다. 배선 시 내부연결선을 줄이기 위한 방안으로 3차원 FPGA가 제안되었다. 하지만 구조의 복잡해짐으로써 오히려 스위치에서 물리적인 연결선들은 더욱 증가하고 스위치의 면적이 증가하는 문제점을 가지게 되었다. 본 논문에서는 복잡성을 낮추어서 물리적인 내부 연결선의 길이를 줄이고, 배선시의 연결선의 길이를 3차원 FPGA만큼 줄일 수 있는 FPGA구조를 제안한다. 그리고 ISE 의 FPGA Editor와 배선 시 길이를 예측하는 프로그램을 사용하여 Xilinx사의 Virtex Ⅱ FPGA와 3D FPGA의 연결선 구성을 비교한다. Field-Programmable Gate Arrays (FPGAs) are a revolutionary new type of userprogrammable integrated circuits that provide fast, inexpensive access to customized VLSI. However, as the target application speed increases, power-consumption and wire-delay on interconnection become more critical factors during programming an FPGA. Especially , the interconnection of the FPGA consumes 65% of the total FPGA power consumption. A previous research show that if the length of interconnection is shirked, power-consumption can be reduced because an interconnection has a lot of effect on power-consumption. For solving this problem that reducing the number of wires routed, the three dimension FPGA is proposed. However, this structure physical wires and an area of switches is increased by making topology complex. This paper propose a novel FPGA architecture that modifies the three dimension FPGA and compare the number of interconnection of Virtex Ⅱ and 3D FPGA with the proposed FPGA architecture using the FPGA Editor of Xilinx ISE and a global routing and length estimation program.
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