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디지털 방송 시스템을 위한 효율적인 LDPC 복호기 설계
장수현(Soohyun Jang),서정욱(Jeongwook Seo),김현식(Hyunsik Kim),이연성(Yeonsung Lee),정윤호(Yunho Jung) 한국방송·미디어공학회 2011 한국방송공학회 학술발표대회 논문집 Vol.2011 No.11
In this paper, an area-efficient architecture of LDPC Decoder is proposed for DVB (Digital Video Broadcasting) 2.0 systems. The proposed LDPC Decoder was designed in hardware description language (HDL) and implemented with Xilinx Virtex-5 FPGA. With the proposed architecture, the number of slices for the decoder is 56122 and the number of block RAM is 135.