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Differentiated space allocation for wear leveling on phase-change memory-based storage device
Soojun Im,Dongkun Shin IEEE 2014 IEEE transactions on consumer electronics Vol.60 No.1
<P>Phase-change memory (PCM) is the best candidate for the storage device of next-generation mobile consumer electronics. PCM has the potential to replace NAND flash memory, due to its non-volatility, in-place programmability, and low power consumption. Even though the lifetime of PCM is longer than that of flash memory, wear leveling is still required to cope with the non-uniformity of storage workload or malicious attack. In this paper, a novel wear-leveling algorithm for PCM storage is proposed, where more physical pages are allocated to frequently updated logical pages, to balance the wear counts of PCM cells. In comparison with the previous techniques, the proposed algorithm improved the lifetime of PCM by at maximum 14 times and on average 8 times<SUP>1</SUP>.</P>
Flash-Aware RAID Techniques for Dependable and High-Performance Flash Memory SSD
Soojun Im,Dongkun Shin IEEE 2011 IEEE Transactions on Computers Vol.60 No.1
<P>Solid-state disks (SSDs), which are composed of multiple NAND flash chips, are replacing hard disk drives (HDDs) in the mass storage market. The performances of SSDs are increasing due to the exploitation of parallel I/O architectures. However, reliability remains as a critical issue when designing a large-scale flash storage. For both high performance and reliability, Redundant Arrays of Inexpensive Disks (RAID) storage architecture is essential to flash memory SSD. However, the parity handling overhead for reliable storage is significant. We propose a novel RAID technique for flash memory SSD for reducing the parity updating cost. To reduce the number of write operations for the parity updates, the proposed scheme delays the parity update which must accompany each data write in the original RAID technique. In addition, by exploiting the characteristics of flash memory, the proposed scheme uses the partial parity technique to reduce the number of read operations required to calculate a parity. We evaluated the performance improvements using a RAID-5 SSD simulator. The proposed techniques improved the performance of the RAID-5 SSD by 47 percent and 38 percent on average in comparison to the original RAID-5 technique and the previous delayed parity updating technique, respectively.</P>
임베디드 그래픽 프로세서를 위한 ESSL 최적화 컴파일러 기법
임수준(Soojun Im),신동군(Dongkun Shin) 한국정보과학회 2012 정보과학회논문지 : 시스템 및 이론 Vol.39 No.6
오늘날 휴대용 기기에서도 화려한 그래픽이 요구됨에 따라 그래픽 프로세서가 널리 사용되고 있다. 이에 따라 크로노스 그룹은 휴대기기를 위한 그래픽 API 표준인 OpenGL ES 2.0을 발표하였다. 본 논문에서는 OpenGL ES 2.0을 기반으로 설계된 그래픽 프로세서를 위한 쉐이더 컴파일러를 개발하였으며 해당 프로세서를 위한 최적화 기법을 연구하였다. 개발된 컴파일러는 OpenGL ESSL로 작성된 쉐이더 프로그램 예제들을 대상으로 정상적인 수행 결과를 보였으며 그래픽 프로세서를 위한 최적화 기법을 적용하여 쉐이더 프로그램의 크기를 최대 10%가량 절감하고 성능을 10~15%가량 향상시켰다. While the requirement of graphic processing keeps increasing significantly, GPU (Graphic Processor Unit) became mandatory component in embedded system today. To achieve low cost and energy consumption with reasonable graphic performance, khronos group introduced OpenGL ES 2.0 which is graphic standard API for embedded system. To use GPU processing with OpenGL shading language, the role of compiler is very important for performance and cost. In this paper we present compiler implementation for embedded GPU with OpenGL ES 2.0 shader program and optimization techniques for target processor. In evaluation, our optimization techniques are reduced code size to 10%, and execution cycle to 10~15%.
[우수논문] 임베디드 그래픽 프로세서를 위한 OpenGL ES 컴파일러 개발
임수준(Soojun Im),송준섭(Junsup Song),신동군(Dongkun Shin) 한국정보과학회 2012 한국정보과학회 학술발표논문집 Vol.39 No.1A
오늘날 휴대용 기기에서의 그래픽 처리 요구사항이 증가함에 따라 저전력, 저비용 그래픽 프로세서의 필요성이 대두되고 있다. 이에 따라 크로노스 그룹은 휴대기기를 위한 그래픽 API 표준인 OpenGL ES 2.0을 발표하였다. 본 논문에서는 OpenGL ES 2.0을 상정하여 구성된 그래픽 프로세서를 위한 쉐이더 컴파일러를 개발하고 최적화하는 연구를 수행하였다. 개발된 컴파일러는 OpenGL ESSL로 작성된 쉐이더 프로그램을 정상적으로 컴파일하고 동작시켰으며 타겟 GPU에 적합한 최적화 기법을 적용하여 쉐이더 프로그램의 크기를 최대 10%가량 절감하고 성능을 10~15%가량 향상시켰다.