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김이석(Yiseok Kim),김용득(Yongduk Kim),박세광(Sekwang Park) 전력전자학회 2006 전력전자학술대회 논문집 Vol.- No.-
이 논문은 PDP의 유지방전 파형을 설계하여 보다 높은 휘도를 얻고 방전 전류를 최소화하여 효율을 높이고자 하였다. PDP의 높은 휘도와 효율 향상을 위하여 서스테인 구간에서의 유지 시간과 휴지 시간을 조절하여 실험하였다. 이 실험으로 패널의 유지 방전시의 유지, 휴지 시간에 따라 벽전하와 하전입자의 형성에 기인하는 마진과 효율을 측정하였다. 실험은 유지 방전 파형의 유지 시간을 0.74 ㎲에서 3.14 ㎲까지, 휴지 시간은 100 ㎱에서 1200 ㎱까지 각각 변화 시키면서 마진과 효율을 측정하였다. 이 실험에서 유지 시간은 효율적인 측면을 고려하여 1.04 ㎲로, 휴지 시간은 마진과 효율이 모두 개선된 100 ㎱가 적절한 것으로 실험 결과 측정되었다. 이러한 결과로 PDP의 유지 방전시 발생하는 벽전하와 하전입자의 현상을 이해하고 적절한 유지 시간과 휴지시간을 고려한 고효율 유지방전 파형을 설계, 응용에 적용할 수 있다.