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      • KCI등재

        포렌식 마킹을 위한 특징점 기반의 동적 멀티미디어 핑거프린팅 코드 설계

        이강현(Kang Hyeon RHEE) 大韓電子工學會 2011 電子工學會論文誌-CI (Computer and Information) Vol.48 No.4

        본 논문에서는 멀티미디어 콘텐츠 보호에 대한 반공모 코드를 위한 동적 멀티미디어 핑거프린팅 코드를 설계하는 알고리즘을 제안한다. 기존의 반공모 코드(ACC: Anti-Collusion Code)를 위한 멀티미디어 핑거프린팅 코드는 BIBD(Balanced Incomplete Block Design)의 접속행렬을 보수행렬로 변환하여 k를 k+1로 증대시키는 수리적 방법으로 설계되었다. 그리고 보수행렬의 코드벡터를 사용자에게 핑거프린팅 코드로 부여하고, 콘텐츠에 삽입하였다. 제안된 알고리즘에서는 사용자가 구매하는 콘텐츠로부터 특징점을 추출하고, 이를 기반으로 동적으로 핑거프린팅 코드를 설계할 수 있도록 BIBD의 v와 k+1 조건을 만족하는 반공모 코드의 후보성 코드를 코드북(Codebook)에 구축하고 λ+1 조건을 만족하는 행렬(이하, Rhee행렬이라 함.)을 생성한다. 실험을 통하여 콘텐츠의 특징점 기반으로 생성된 Rhee행렬의 코드벡터는 v비트의 유의수준 (1-α)에서 신뢰구간에 k가 존재하며, Rhee행렬의 각 행과 행, 열과 열 사이의 유클리디안 거리가 BIBD 기반의 보수행렬과 그래프 기반의 보수행렬과 같은 k값이 산출되었다. 더욱이 Rhee행렬의 첫 행과 첫 열은 생성과정에서 초기 점화벡터로 콘텐츠 포렌식 마크 정보가 되며, 이와 관계가 있는 나머지 코드벡터들과의 관계성이 코드북에 기록되어 있기 때문에, 공모된 코드를 추적할 때 원 핑거프린팅 코드의 상관관계 계수를 구할 필요 없이 코드북의 탐색으로 공모자를 추적이 용이하다. 따라서 본 논문에서 생성된 Rhee행렬은 수리적으로 생성된 BIBD 기반의 행렬보다 ACC로서 강인성과 충실도가 우수하다. In this paper, it was presented a design on the dynamic multimedia fingerprinting code for anti-collusion code(ACC) in the protection of multimedia content. Multimedia fingerprinting code for the conventional ACC, is designed with a mathematical method to increase k to k+1 by transform from BIBD's an incidence matrix to a complement matrix. A codevector of the complement matrix is allowanced fingerprinting code to a user' authority and embedded into a content. In the proposed algorithm, the feature points were drawing from a content which user bought, with based on these to design the dynamical multimedia fingerprinting code. The candidate codes of ACC which satisfied BIBD's v and k+1 condition is registered in the codebook, and then a matrix is generated(Below that it calls “Rhee matrix”) with λ+1 condition. In the experimental results, the codevector of Rhee matrix based on a feature point of the content is generated to exist k in the confidence interval at the significance level (1-α). Euclidean distances between row and row and column and column each other of Rhee matrix is working out same k value as like the compliment matrices based on BIBD and Graph. Moreover, first row and column of Rhee matrix are an initial firing vector and to be a forensic mark of content protection. Because of the connection of the rest codevectors is reported in the codebook, when trace a colluded code, it isn't necessity to solve a correlation coefficient between original fingerprinting code and the colluded code but only search the codebook then a trace of the colluder is easy. Thus, the generated Rhee matrix in this paper has an excellent robustness and fidelity more than the mathematically generated matrix based on BIBD as ACC.

      • KCI등재

        Fourier 변환 변이계수를 이용한 미디언 필터링 영상의 포렌식 판정

        이강현(Kang Hyeon RHEE) 대한전자공학회 2015 전자공학회논문지 Vol.52 No.8

        디지털 영상의 배포에서, 위·변조자에 의해 영상이 변조되는 심각한 문제가 있다. 이러한 문제를 해결하기 위하여, 본 논문에서는 영상의 Fourier 변환 변이계수를 이용한 미디언 필터링 (Median Filtering: MF) 영상의 포렌식 판정 알고리즘을 제안한다. 제안된 알고리즘에서, 영상의 각 수평, 수직라인의 Fourier 변환 (Fourier Transform: FT)을 하고, 이웃 라인과의 변이계수를 기반으로 하여 MF 검출 (Median Filtering Detection: MFD)을 위한 10 Dim. 특징벡터를 정의한다. 이는 MF 검출기의 SVM (Support Vector Machine) 학습에 사용된다. 제안된 미디언 필터링 검출 스킴은 동일 10 Dim. 특징벡터의 MFR (Median Filter Residual)과 Rhee의 MF 검출 스킴과 비교하여 원영상, JPEG (QF=90), Down 스케일링 (0.9) 그리고 Up 스케일링 (1.1) 영상에서는 성능이 우수하며, Gaussian 필터링 (3×3) 영상에서는 성능이 일부 높았다. 제안된 알고리즘은 성능평가 전체항목에서 민감도 (Sensitivity; TP: True Positive rate)와 1-특이도 (1-Specificity; FP: False Positive rate)에 의한 AUC (Area Under ROC (Receiver Operating Characteristic) Curve)가 모두 1에 수렴하여 ‘Excellent (A)’ 등급임을 확인하였다. In a distribution of digital image, there is a serious problem that is the image alteration by a forger. For the problem solution, this paper proposes the forensic decision algorithm of a median filtering (MF) image using the feature vector based on a coefficient of variation (c.v.) of Fourier transform. In the proposed algorithm, we compute Fourier transform (FT) coefficients of row and column line respectively of an image first, then c.v. between neighboring lines is computed. Subsquently, 10 Dim. feature vector is defined for the MF detection. On the experiment of MF detection, the proposed scheme is compared to MFR (Median Filter Residual) and Rhee"s MF detection schemes that have the same 10 Dim. feature vector both. As a result, the performance is excellent at Unaltered, JPEG (QF=90), Down scaling (0.9) and Up scaling (1.1) images, and it showed good performance at Gaussian filtering (3×3) image. However, in the performance evaluation of all measured items of the proposed scheme, AUC (Area Under ROC (Receiver Operating Characteristic) Curve) by the sensitivity and 1-specificity approached to 1 thus, it is confirmed that the grade of the performance evaluation is rated as "Excellent (A)".

      • 차분 순회부호를 이용한 비디오 전송의 오류정정

        이강현,노진수 조선대학교 에너지.자원신기술연구소 2002 에너지·자원신기술연구소 논문지 Vol.24 No.2

        본 논문에서는 일본 TV방송 및 디지털 비디오의 전송 오류정정에 쓰이는 차분 순회부호(Differential Cyclic Code)의 오류 정정회로를 설계한다. 차분 순회부호는 송신기(Transmitter)와 수신기(Receiver)에서 사용되는데, 송신기의 회로는 11비트의 정보비티에 의해 10비트의 패리티비트를 생성하고, 수신기의 회로는 송신기에서 나온 출력 값 21비트 패킷을 신드롬 계산법과, 과반수 논리(Majority Logic)에 의해 오류를 검출, 정정한다. 본 논문에서 제안한 차분 순회부호 오류정정 회로 설계는 VHDL에 의해 코딩되었고, 시뮬레이션, 설계합성을 통하여 레이아웃을 하였다.

      • 산업용 Robot言語의 解析器 設計

        李康鉉,朴暢均 조선대학교 동력자원연구소 1986 動力資源硏究所誌 Vol.8 No.2

        This paper deals with the design of interpreter for the industrial robot systems, and then concatenated operation with other robot systems in the industrial lines. A design method of the driving circuits for the DC-servo motor is suggested an algorithm using the Digital Position Locked Loop(DPLL). Robot arms, which are used in this investigation, are 3-dimension controllable and rotationable. As the result 1) we can easily operate the system as the robot language is defined the single key format with actuated motion. 2) it is cost effective system because the system can be deleted the extra controller for each motor. 3) it is improved the system precision by using the DPLL.

      • AALG의 檢査패턴 減小를 위한 硏究

        李康鉉 조선대학교 동력자원연구소 1990 動力資源硏究所誌 Vol.12 No.1

        This paper proposes the reduction for the test patterns of AAL(Subscripted D -Algorithm) in a combinationl logic circuit with non- feed back. The propese algorithm os called MSSA(Multiple path & Sinfle path Sensitization Algorithm) that defined the multiple path segments and the single path segments. As a results, the MSSA generates the minimal length test patterns and recuces the test patterns less than AALG.

      • 공장자동화의 네트워크프로세서 설계

        이강현 조선대학교 에너지.자원신기술연구소 2003 에너지·자원신기술연구소 논문지 Vol.25 No.1

        본 논문은 공장자동화의 제어기기에 사용하는 네트워크프로세서(Networkprocessor)를 설계하였으며, ARM Core 기반 SoC Master 장비를 이용하여 client host에서 신뢰할 수 있는 데이터의 제어 및 전송을 처리한다. 제어기기 내의 네트워크 상의 패킷처리를 CPU가 아닌 네트워크프로세서라는 보조프로세서를 이용하여 클라이언트 모드의 Active Open일 때와 서버 모드의 Passive Open일 때의 데이터 처리 알고리즘을 제안하고 네트워크프로세서를 설계하였다. 헤더 분석(Header Parsing), 비트 필드 조작(Bit-Field Manipulation), 패턴 매칭 (Pattern Matching), 패킷 수정(Packet Modification), 테이블 룩업(Table Look-Up), 메시지 트래픽 관리(Traffic Management)등의 계층간의 패킷 처리가 인터넷 네트워크를 통하여 수행됨을 확인하였다.

      • 8비트 RISC 프로세서 설계

        성해경,이강현 조선대학교 에너지.자원신기술연구소 2003 에너지·자원신기술연구소 논문지 Vol.25 No.1

        An importance about the complicated function and the operation speed of arithmetic is rising its head on the info-communication society which has rapidly development. Currently, 8bit RISC processor is used widely in the info-communication systems. Also, the core library of RISC processor can be applied easily in embedded system. So it requires more complicated function and the fast operation speed of arithmetic to all systems. In this paper, the authors designed 8bit RISC processor for high speed operation core that is able to applying the embedded system. The design specification proposed has 15 instructions, and we confirmed that Vdd is 3.3V when clock frequency is 50㎒.

      • 고속 가변길이 디코더 설계

        이문구,이강현 조선대학교 에너지.자원신기술연구소 2003 에너지·자원신기술연구소 논문지 Vol.25 No.1

        In this paper, Design on high speed VLD(Variable Length Decoder) using pipeline structure. Variable Length Decoder is received Nbit data from input block and decode signal via Shifting Buffer, Length Decoder and Symbol Decoder. The interior of shifting buffer in proposed Variable Length Decoder is filled input data then decoded with high speed using the pipeline structure, in here whose data is decoded in every clock.

      • t-분포를 이용한 의사-전체검사에 관한 연구

        조형철,이정현,이강현 조선대학교 에너지.자원신기술연구소 2002 에너지·자원신기술연구소 논문지 Vol.24 No.1

        This paper deals with the path sensitization algorithm from PI to PO center on the nodes of high testability mainstay when CUT is tested by pseudo-exhaustive testing. Focusing on the defined nodes of high testability mainstay, we performed the singular cover and consistency operation to the forward and backward logic gates. Thus, we easily generated the pseudo-exhaustive test patterns. As a result, (1-α) region has 0.1579 and the pseudo-exhaustive test patterns are least generated and the rate of test pattern is 1.22%, compared with exhaustive testing. (1-α region has 0.2368 and this result exhibits the optimal performance of the singular cover and consistency operation. Applying the generated pseudo-exhaustive test patterns to the stuck at faults existing on the inputs and internal nodes in CUT, we verified this performance on the output. Thus, it is confirmed that fuctional testing of the proposed path sensitization algorithm is very useful.

      • One-time 라운딩을 갖는 DES소자

        김지은,노진수,이강현 조선대학교 에너지.자원신기술연구소 2002 에너지·자원신기술연구소 논문지 Vol.24 No.1

        Recent concerns about information privacy have enhanced the need for data security when storing information in a computer or transmitting it through data communication network. In this paper, we proposed the design DES(Data Encryption Standard) algorithm, which is regarded as a standard of encryption algorithm. We could design it by using of one-time ounging wit the implemental method, S-box sharing method, and the simple-round iterative method, and implement ASIC into simple-round iterative method have the smallest size and alternate to have a general purpose. Each part is designed in accordance with a type of the Top-down design using VHDL(Very high speed IC Hardware Description Language), this is designing technical language which is adopted as the international standard language, and. synthesized.

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