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저전력 VLSI SOC 최적화를 위한 3T_GC_eDRAM 분석
천현준(Hyeon-Jun Cheon),채주형(Joo-Hyung Chae) 대한전자공학회 2022 대한전자공학회 학술대회 Vol.2022 No.11
In this paper, we perform an analysis of existing 3T_GC_eDRAM cells (Conventional_3T, Boosted_3T, TG_3T) to determine the suitable cells for low-power VLSI SOC among 3T. Use comparison and analysis to select the best cell for implementing low-power VLSI SOC and explain why.