본 논문에서는 다시점 3D 디스플레이 시스템의 구현을 위한 핵심기술로, 4대의 CCD 카메라로 입력되는 영상 신호를 디지털 데이터로 변환하기 위한 4시점 역 다중화기 설계에 대한 알고리즘을...

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서울: 광운대학교, 2003
2003
한국어
621.381
서울
vi, 51 p.: 삽도; 26 cm.
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본 논문에서는 다시점 3D 디스플레이 시스템의 구현을 위한 핵심기술로, 4대의 CCD 카메라로 입력되는 영상 신호를 디지털 데이터로 변환하기 위한 4시점 역 다중화기 설계에 대한 알고리즘을 제안하고 구현하였다. 즉, 27 MHz의 각 채널별 동작 주파수를 통해 디지털 텔레비전의 부호화 파라미터인 CCIR-601를 출력으로 선정하여 525 또는 625 라인의 컴포넌트 영상 신호를 디지털 신호로 변환 하였으며, 검출된 4시점의 영상 데이터는 동영상 압축 표준인 MPEG 대신에 SD급 M-JPEG 압축 표준을 이용하여 MPEG에 비해 상대적으로 압축률은 낮지만 다시점의 영상을 실시간 압축 및 편집이 가능하게 설계하였다. 또한, IBM PC 인터페이스인 PCI 기반의 방식으로 설계함으로써, 향후 시점의 확장성에도 적응적으로 대처할 수 있는 새로운 형태의 4시점 역 다중화 시스템을 구현하였다.
제안된 설계 알고리즘의 시뮬레이션 결과, 각 채널을 제어하기 위한 54 MHz의 멀티플렉서의 속도 검출을 통해 4시점 영상 데이터의 실시간 저장 및 디스플레이가 가능함을 확인할 수 있었으며, 기존의 2시점 스테레오 디스플레이 방식에서 벗어나, 더욱 진보한 형태의 4시점 영상 처리를 위한 SD급 비디오 시스템 및 역 다중화기를 설계 및 구현하여 향후 8시점 이상의 영상처리 보드 개발의 가능성을 확인하였다.
다국어 초록 (Multilingual Abstract)
In this thesis, the algorithm of the key technology for realizing multi-view 3D display system about the 4-view de-multiplexer's design for converting four CCD camera's input image to digital data is proposed and realized. That is, 525 or 625 line's ...
In this thesis, the algorithm of the key technology for realizing multi-view 3D display system about the 4-view de-multiplexer's design for converting four CCD camera's input image to digital data is proposed and realized. That is, 525 or 625 line's component image signal is converted to digital signal through picking out CCIR-601 which is the digital TV's sign parameter to output with each channel's acting frequency of 27 MHz. The design is made for multi-view image's real-time compressing and editing even though compression rate is relatively lower than MPEG because the detected 4-view image data is compressed with the SD class M-JPEG standard compression method instead of the MPEG, standard moving picture. Also, by designing with PCI based technology which is one of the IBM PC interface, new type's 4-view de-multiplexer system which could manage accommodately to future view point's dilation is realized.
As a results of proposed design algorithm's simulation, the possibility of 4-view image data's real-time storage and display is checked through the speed detection of the 54 MHz multiplexer which is used for each channel's control. The possibility of developing image processing board more than 8-view is confirmed through designing and realizing de-multiplexer and SD class's video system for the 4-view image processing advanced more than 2-view stereo display's video system.
목차 (Table of Contents)