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본 과제에서는 GND System의 동시 스위칭 잡음(SSN)과 관련되어 논리적 잘못으로 직결될 수 있는 중요한 문제인 V_DD/V_SS pad의 최소수를 예측하는 설계 방법을 연구하였다 1차적 예측을 위해서 간...
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부가정보
국문 초록 (Abstract)
본 과제에서는 GND System의 동시 스위칭 잡음(SSN)과 관련되어 논리적 잘못으로 직결될 수 있는 중요한 문제인 V_DD/V_SS pad의 최소수를 예측하는 설계 방법을 연구하였다 1차적 예측을 위해서 간단한 해석치 공식을 사용할 수 있으며, 보다 더 정확한 예측을 위해서 간단한 해석적 공식을 사용할 수 있고, 이에 대해 회로 모형 및 회로 구성 예를 보였다. 이로부터 delay특성의 한계 이내라면 가능한 작은 driver를 선택하는 것이 동시 스위칭 잡음을 줄이는 길이 된다는 것을 보였다 따라서 본 과제를 통하여 V_DD/V_SS pad의 초소수를 효율적으로 예측할 수 있게 되었다.
본 과제에서는 GND System의 동시 스위칭 잡음(SSN)과 관련되어 논리적 잘못으로 직결될 수 있는 중요한 문제인 V_DD/V_SS pad의 최소수를 예측하는 설계 방법을 연구하였다 1차적 예측을 위해서 간단한 해석치 공식을 사용할 수 있으며, 보다 더 정확한 예측을 위해서 간단한 해석적 공식을 사용할 수 있고, 이에 대해 회로 모형 및 회로 구성 예를 보였다. 이로부터 delay특성의 한계 이내라면 가능한 작은 driver를 선택하는 것이 동시 스위칭 잡음을 줄이는 길이 된다는 것을 보였다 따라서 본 과제를 통하여 V_DD/V_SS pad의 초소수를 효율적으로 예측할 수 있게 되었다.
목차 (Table of Contents)
- 요약문
- 제1장 서론
- 제2장 출력 셀에 필요한 VSS/VDL pad 수를 결정하는 Design Rule
- 요약문
- 제1장 서론
- 제2장 출력 셀에 필요한 VSS/VDL pad 수를 결정하는 Design Rule
- 제3장 대수적인 방식에 의한 VSS/VDL pad 수 계산
- 제4장 Simulation을 통한 검증
- 제5장 결론
- 참고문헌
- 별첨 회로 모형에 대한 Netlist
분석정보
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