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ア ァ カ サ ザ タ ダ ナ ハ バ パ マ ヤ ャ ラ ワ ヮ ン イ ィ キ ギ シ ジ チ ヂ ニ ヒ ビ ピ ミ リ ウ ゥ ク グ ス ズ ツ ヅ ッ ヌ フ ブ プ ム ユ ュ ル エ ェ ケ ゲ セ ゼ テ デ ヘ ベ ペ メ レ オ ォ コ ゴ ソ ゾ ト ド ノ ホ ボ ポ モ ヨ ョ ロ ヲ ―

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Α Β Γ Δ Ε Ζ Η Θ Ι Κ Λ Μ Ν Ξ Ο Π Ρ Σ Τ Υ Φ Χ Ψ Ω α β γ δ ε ζ η θ ι κ λ μ ν ξ ο π ρ σ τ υ φ χ ψ ω
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§ ※ ☆ ★ ○ ● ◎ ◇ ◆ □ ■ △ ▽ → ← ↑ ↓ ↔ 〓 ◁ ◀ ▷ ▶ ♤ ♠ ♡ ♥ ♧ ♣ ⊙ ◈ ▣ ◐ ◑ ▒ ▤ ▥ ▨ ▧ ▦ ▩ ♨ ☏ ☎ ☜ ☞ † ‡ ↕ ↗ ↙ ↖ ↘ ♭ ♩ ♪ ♬ ㉿ ㈜ № ㏇ ™ ㏂ ㏘ ℡ ＃ ＆ ＊ ＠ ª º
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      열처리 조건이 실리콘 기판위의 $Ta_2O_5$ 박막에 미치는 영향

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      https://www.riss.kr/link?id=A103878870

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      Ta₂O/Si 계면에서 SiO₂층이 dry O₂ 및 N₂분위기에서 열처리에 의해 형성되며 열처리 온도가 증가할수록 이층의 두께가 증가한다. Dry O₂ 및 N₂에서 열처리 할 때 얇은 Ta₂O 박막(40nm 이하)의 누설전류는 열처리 온도가 증가함에 따라 감소한다. 유전상수 vs 열처리 온도 관계에서 750℃또는 800℃에서 Ta₂O 박막의 결정화에 따른 최대값을 보여주며, 이러한 결정화에 의한 유전상수 증가 효과는 두꺼운 Ta₂O 박막에서 현저히 나타난다. 그러나 고온에서 열처리하면 계면에서 SiO₂층의 형성과 성장 때문에 유전상수는 감소한다. Al/Ta₂O/Si MIS capacitor의 stress에 따른 flat band voltage와 gate voltage instability는 열처리에 의해서 형성된 계면 SiO₂성장으로 설명할 수 있다. 열처리 조건의 함수로서 Ta₂O박막의 전기적 특성은 Ta₂O박막형성 방법에 관계없이 Ta₂O 박막 두께에 강하게 의존한다.
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      Ta₂O/Si 계면에서 SiO₂층이 dry O₂ 및 N₂분위기에서 열처리에 의해 형성되며 열처리 온도가 증가할수록 이층의 두께가 증가한다. Dry O₂ 및 N₂에서 열처리 할 때 얇은 Ta₂O 박막(40nm 이하)의 ...

      Ta₂O/Si 계면에서 SiO₂층이 dry O₂ 및 N₂분위기에서 열처리에 의해 형성되며 열처리 온도가 증가할수록 이층의 두께가 증가한다. Dry O₂ 및 N₂에서 열처리 할 때 얇은 Ta₂O 박막(40nm 이하)의 누설전류는 열처리 온도가 증가함에 따라 감소한다. 유전상수 vs 열처리 온도 관계에서 750℃또는 800℃에서 Ta₂O 박막의 결정화에 따른 최대값을 보여주며, 이러한 결정화에 의한 유전상수 증가 효과는 두꺼운 Ta₂O 박막에서 현저히 나타난다. 그러나 고온에서 열처리하면 계면에서 SiO₂층의 형성과 성장 때문에 유전상수는 감소한다. Al/Ta₂O/Si MIS capacitor의 stress에 따른 flat band voltage와 gate voltage instability는 열처리에 의해서 형성된 계면 SiO₂성장으로 설명할 수 있다. 열처리 조건의 함수로서 Ta₂O박막의 전기적 특성은 Ta₂O박막형성 방법에 관계없이 Ta₂O 박막 두께에 강하게 의존한다.

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