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      KCI등재

      RTL 회로의 데이터패스를 위한 비주사 DFT 기법 = An Non-Scan DFT Scheme for RTL Circuit Datapath

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      https://www.riss.kr/link?id=A104287157

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      다국어 초록 (Multilingual Abstract)

      In this paper, An efficient non-scan DFT method for datapaths described in RTL is proposed. The proposed non-scan DFT method improves testability of datapaths based on hierarchical testability analysis regardless to width of the datapath. It always guarantees higher fault efficiency and faster test pattern generation time with little hardware overhead than previous methods. The experimental result shows the superiority of the proposed method of test pattern generation time, application time, and area overhead compared to the scan method.
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      In this paper, An efficient non-scan DFT method for datapaths described in RTL is proposed. The proposed non-scan DFT method improves testability of datapaths based on hierarchical testability analysis regardless to width of the datapath. It always gu...

      In this paper, An efficient non-scan DFT method for datapaths described in RTL is proposed. The proposed non-scan DFT method improves testability of datapaths based on hierarchical testability analysis regardless to width of the datapath. It always guarantees higher fault efficiency and faster test pattern generation time with little hardware overhead than previous methods. The experimental result shows the superiority of the proposed method of test pattern generation time, application time, and area overhead compared to the scan method.

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      국문 초록 (Abstract)

      본 논문에서는 레지스터 전송 수준의 데이터패스를 위한 효율적인 비주사 DFT 기법을 제안하였다. 데이터패스를 위해 제안된 비주사 DFT 기법은 레지스터 전송 수준(RTL:register transfer level) 회로에 대한 계층적 테스트 용이도(hierarchical testability) 분석을 통해 테스트 용이도를 향상시킴으로써 최소의 하드웨어 오버헤드를 가지고 데이터패스 버스 폭의 변화와 관계없이 항상 높은 고장 효율과 빠른 테스트 패턴 생성 시간을 보장한다. 실험 결과를 통하여 제안된 기법이 주사 기법보다 테스트 패턴 생성 시간, 테스트 패턴 적용 시간, 면적 오버헤드 면에서 우수함을 확인하였다.
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      본 논문에서는 레지스터 전송 수준의 데이터패스를 위한 효율적인 비주사 DFT 기법을 제안하였다. 데이터패스를 위해 제안된 비주사 DFT 기법은 레지스터 전송 수준(RTL:register transfer level) 회...

      본 논문에서는 레지스터 전송 수준의 데이터패스를 위한 효율적인 비주사 DFT 기법을 제안하였다. 데이터패스를 위해 제안된 비주사 DFT 기법은 레지스터 전송 수준(RTL:register transfer level) 회로에 대한 계층적 테스트 용이도(hierarchical testability) 분석을 통해 테스트 용이도를 향상시킴으로써 최소의 하드웨어 오버헤드를 가지고 데이터패스 버스 폭의 변화와 관계없이 항상 높은 고장 효율과 빠른 테스트 패턴 생성 시간을 보장한다. 실험 결과를 통하여 제안된 기법이 주사 기법보다 테스트 패턴 생성 시간, 테스트 패턴 적용 시간, 면적 오버헤드 면에서 우수함을 확인하였다.

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      참고문헌 (Reference)

      1 S. Bhattacharya, "Transformations and Resynthesis for Testability of RTL Control-Data Path Specifications" 1 : 304-318,

      2 R. S. Fetherson, "Testability Features of AMD-K6TM Microprocessor" 64-69, 1998.

      3 D. Bhavsar, "Testability Access of the High Speed Test Features in the Alpha 21264 Microprocessor" 487-495, 1998.

      4 B. Norwood, "Orthogonal SCAN:Low Overhead SCAN for Data Paths" 659-668, 1996.

      5 V. Fernandez, "High-level test synthesis based on controller redefinition" 1596-1597, 1997.

      6 Mike Tien, "High-Level Test Syntheis of Dighital VLSI Circuits" Artech House 1997.

      7 S. Bhattacharya, "H_SCAN:A High Level Alternative to Full-Scan Testing with Reduced Area and Test Application Overheads" 74-80, 1996.

      8 I. Ghosh, "Design for Hierarchical Testability of RTL Circuits Obtained by Behavioral Synthesis" 173-179, 1995.

      9 I. Ghosh, "A Design-for-Testability Technique for Register-Transfer Level Circuits Using Control/Data Flow Extraction" 706-723, 1998.

      10 S. Ohtake,, "A DFT Method for RTL Circuits to Achieve Complete Fault Efficiency Based on Fixed-control Testability" 331-334, 2001.

      1 S. Bhattacharya, "Transformations and Resynthesis for Testability of RTL Control-Data Path Specifications" 1 : 304-318,

      2 R. S. Fetherson, "Testability Features of AMD-K6TM Microprocessor" 64-69, 1998.

      3 D. Bhavsar, "Testability Access of the High Speed Test Features in the Alpha 21264 Microprocessor" 487-495, 1998.

      4 B. Norwood, "Orthogonal SCAN:Low Overhead SCAN for Data Paths" 659-668, 1996.

      5 V. Fernandez, "High-level test synthesis based on controller redefinition" 1596-1597, 1997.

      6 Mike Tien, "High-Level Test Syntheis of Dighital VLSI Circuits" Artech House 1997.

      7 S. Bhattacharya, "H_SCAN:A High Level Alternative to Full-Scan Testing with Reduced Area and Test Application Overheads" 74-80, 1996.

      8 I. Ghosh, "Design for Hierarchical Testability of RTL Circuits Obtained by Behavioral Synthesis" 173-179, 1995.

      9 I. Ghosh, "A Design-for-Testability Technique for Register-Transfer Level Circuits Using Control/Data Flow Extraction" 706-723, 1998.

      10 S. Ohtake,, "A DFT Method for RTL Circuits to Achieve Complete Fault Efficiency Based on Fixed-control Testability" 331-334, 2001.

      11 S. Dey, "A Controller-Based Design-for-Testability Technique for Controller-Data Path Circuits" 534-540, 1995.

      12 I. Ghosh, "A BIST Scheme for RTL Circuits Based on Symbolic Testability Analysis" 19 (19): 111-128, Jan.2000

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      학술지 이력

      학술지 이력
      연월일 이력구분 이력상세 등재구분
      2014-01-21 학회명변경 영문명 : The Institute Of Electronics Engineers Of Korea -> The Institute of Electronics and Information Engineers
      2012-09-01 평가 학술지 통합(등재유지)
      2011-01-01 평가 등재학술지 유지(등재유지) KCI등재
      2009-01-01 평가 등재학술지 유지(등재유지) KCI등재
      2007-10-04 학술지명변경 한글명 : 전자공학회논문지 - SD</br>외국어명 : SemiconductorandDevices KCI등재
      2007-01-01 평가 등재학술지 유지(등재유지) KCI등재
      2005-01-01 평가 등재학술지 유지(등재유지) KCI등재
      2002-07-01 평가 등재학술지 선정(등재후보2차) KCI등재
      2000-01-01 평가 등재후보학술지 선정(신규평가) KCI등재후보
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