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      FCCSP용 기판의 warpage에 미치는 설계인자와 두께편차 영향에 대한 수치적 해석 = Numerical Analysis on the Design Variables and Thickness Deviation Effects on Warpage of Substrate for FCCSP

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      https://www.riss.kr/link?id=A101204723

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      다국어 초록 (Multilingual Abstract)

      In this paper, numerical analysis by finite element method, parameter design by the Taguchi method and ANOVA method were used to analyze about effect of design deviations and thickness variations on warpage of FCCSP substrate. Based on the computed re...

      In this paper, numerical analysis by finite element method, parameter design by the Taguchi method and ANOVA method were used to analyze about effect of design deviations and thickness variations on warpage of FCCSP substrate. Based on the computed results, it was known that core material in substrate was the most determining deviation for reducing warpage. Solder resist, prepreg and circuit layer were insignificant effect on warpage relatively. But these results meant not thickness effect was little importance but mechanical properties of core material were very effective. Warpage decreased as Solder resist and circuit layer thickness decreased but effect of prepreg thickness was conversely. Also, these results showed substrate warpage would be increased to maximum 40% as thickness deviation combination. It meant warpage was affected by thickness tolerance under manufacturing process even if it were met quality requirements. Threfore, it was strongly recommended that substrate thickness deviation should be optimized and controlled precisely to reduce warpage in manufacturing process.

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      국문 초록 (Abstract)

      본 논문에서는 FCCSP용 기판의 휨에 미치는 설계인자와 두께편차의 영향도를 분석하고 최적설계조건을 도출하기 위해 유한요소법에 의한 수치해석을 사용하였고 다구찌법에 의한 파라메타...

      본 논문에서는 FCCSP용 기판의 휨에 미치는 설계인자와 두께편차의 영향도를 분석하고 최적설계조건을 도출하기 위해 유한요소법에 의한 수치해석을 사용하였고 다구찌법에 의한 파라메타설계와 분산분석을 수행하였다. 해석 결과에 의하면 휨에 미치는 영향은 코어재료가 가장 크고 층별 두께(솔더레지스트, 프리프레그, 회로층)의 영향도는 낮은 것으로 분석되었다. 이때 솔더 레지스트와 프리프레그의 두께는 감소할수록 기판 휨은 감소하지만 회로층의 두께는 증가할수록 기판 휨이 감소하였다. 또한, 기판 휨에 대한 두께편차의 영향도 분석결과에 의하면 두께편차의 조합에 따라 기판휨은 최대 40%까지 증가하였다. 이것은 비록 개별 층의 두께편차가 기판품질 수준에 부합하더라도 두께편차 조합조건에 따라 기판 휨이 크게 달라질 수 있다는 것을 의미한다. 따라서, 제조공정에서 기판 휨을 줄이기 위해서 기판두께편차는 최적화되고 정밀하게 제어되어야 한다.

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      참고문헌 (Reference)

      1 박성현, "현대실험계획법" 민영사 2003

      2 Zhang Wenge, "The effects of underfill epoxy on warpage in flip-chip assembles" 21 (21): 323-, 1998

      3 Mario A. Bolanos, "Semiconductor IC Packaging Technology Challenges:The Next Five Years" Texas Instruments

      4 Darveaux, "Reliability of Plastic Ball Grid Array Assembly, In Ball Grid Array Technology" McGraw-Hill 1995

      5 조승현, "New dummy design and stiffener on warpage reduction in Ball Grid Array Printed Circuit Board" PERGAMON-ELSEVIER SCIENCE LTD 50 : 242-250, 201002

      6 "MARC 2011 user manual"

      7 Ming-Yi Tsi, "Investgation of thermomechanical behaviors of flip chip BGA packages during manufacuring process and thermal cycling" 27 (27): 568-, 2004

      8 R. Darveaux, "Interface Failure in Lead Free Solder Joints" 2006

      9 조승현, "Estimation of warpage and thermal stress of IVHs in flip-chip ball grid arrays package by FEM" Elsevier BV 48 (48): 300-309, 200802

      10 Lau, "Electronic Packaging: Design, Materials, Process, and Reliability" McGraw-Hill 1997

      1 박성현, "현대실험계획법" 민영사 2003

      2 Zhang Wenge, "The effects of underfill epoxy on warpage in flip-chip assembles" 21 (21): 323-, 1998

      3 Mario A. Bolanos, "Semiconductor IC Packaging Technology Challenges:The Next Five Years" Texas Instruments

      4 Darveaux, "Reliability of Plastic Ball Grid Array Assembly, In Ball Grid Array Technology" McGraw-Hill 1995

      5 조승현, "New dummy design and stiffener on warpage reduction in Ball Grid Array Printed Circuit Board" PERGAMON-ELSEVIER SCIENCE LTD 50 : 242-250, 201002

      6 "MARC 2011 user manual"

      7 Ming-Yi Tsi, "Investgation of thermomechanical behaviors of flip chip BGA packages during manufacuring process and thermal cycling" 27 (27): 568-, 2004

      8 R. Darveaux, "Interface Failure in Lead Free Solder Joints" 2006

      9 조승현, "Estimation of warpage and thermal stress of IVHs in flip-chip ball grid arrays package by FEM" Elsevier BV 48 (48): 300-309, 200802

      10 Lau, "Electronic Packaging: Design, Materials, Process, and Reliability" McGraw-Hill 1997

      11 Lau John, "Effects of Build-Up Printed Circuit Board Thickness in the Solder Joint Reliability of a Wafer Level Chip Scale Package(WLCSP)" 25 (25): 3-, 2002

      12 X. J. Fan, "Design and optimization of thermo-mechanical reliability in wafer level packaging" 50 (50): 536-, 2010

      13 Chiu Christine, "Challenges of thin core PCB Flip Chip package on advanced Si Nodes" 2007

      14 Elva Lin, "Advantage and challenge of coreless Flipchip BGA Microsystems" 346-, 2007

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      2018-01-01 평가 등재학술지 유지 (등재유지) KCI등재
      2015-01-01 평가 등재학술지 유지 (등재유지) KCI등재
      2011-06-28 학술지명변경 한글명 : 마이크전자 및 패키징학회지 -> 마이크로전자 및 패키징학회지
      외국어명 : The Microelectronics and Packaging Society -> Jornal of the Microelectronics and Packaging Society
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      2011-01-01 평가 등재학술지 유지 (등재유지) KCI등재
      2009-01-01 평가 등재 1차 FAIL (등재유지) KCI등재
      2007-01-01 평가 등재학술지 유지 (등재유지) KCI등재
      2004-01-01 평가 등재학술지 선정 (등재후보2차) KCI등재
      2003-01-01 평가 등재후보 1차 PASS (등재후보1차) KCI등재후보
      2001-07-01 평가 등재후보학술지 선정 (신규평가) KCI등재후보
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      기준연도 WOS-KCI 통합IF(2년) KCIF(2년) KCIF(3년)
      2016 0.48 0.48 0.43
      KCIF(4년) KCIF(5년) 중심성지수(3년) 즉시성지수
      0.39 0.35 0.299 0.35
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