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이 학술지의 논문 검색
Chen, C. R.; Wong, W. S.; Chiu, C. T. INSTITUTE OF ELECTRICAL AND ELECTRONICS ENGINEERS 2011 p.1937-1948
A Hybrid Scheme for On-Chip Voltage Regulation in System-On-a-Chip (SOC)
Gjanci, J.; Chowdhury, M. H. INSTITUTE OF ELECTRICAL AND ELECTRONICS ENGINEERS 2011 p.1949-1959
Power-Supply Noise Reduction Using Active Inductors in Mixed-Signal Systems
Taparia, A.; Banerjee, B.; Viswanathan, T. R. INSTITUTE OF ELECTRICAL AND ELECTRONICS ENGINEERS 2011 p.1960-1968
Path Delay Test Generation Toward Activation of Worst Case Coupling Effects
Zhang, M.; Li, H.; Li, X. INSTITUTE OF ELECTRICAL AND ELECTRONICS ENGINEERS 2011 p.1969-1982
A Low-Cost Built-In Redundancy-Analysis Scheme for Word-Oriented RAMs With 2-D Redundancy
Tseng, T. W.; Li, J. F. INSTITUTE OF ELECTRICAL AND ELECTRONICS ENGINEERS 2011 p.1983-1995
Full Fault Resilience and Relaxed Synchronization Requirements at the Cache-Memory Interface
Yang, C.; Orailoglu, A. INSTITUTE OF ELECTRICAL AND ELECTRONICS ENGINEERS 2011 p.1996-2009
Application-Aware Topology Reconfiguration for On-Chip Networks
Modarressi, M.; Tavakkol, A.; Sarbazi-Azad, H. INSTITUTE OF ELECTRICAL AND ELECTRONICS ENGINEERS 2011 p.2010-2022
FPGA Based on Integration of CMOS and RRAM
Tanachutiwat, S.; Liu, M.; Wang, W. INSTITUTE OF ELECTRICAL AND ELECTRONICS ENGINEERS 2011 p.2023-2032
Configurable Multimode Embedded Floating-Point Units for FPGAs
Chong, Y. J.; Parameswaran, S. INSTITUTE OF ELECTRICAL AND ELECTRONICS ENGINEERS 2011 p.2033-2044
Reconfigurable Routers for Low Power and High Performance
Matos, D.; Concatto, C.; Kreutz, M.; Kastensmidt, F.; Carro, L.; Susin, A. INSTITUTE OF ELECTRICAL AND ELECTRONICS ENGINEERS 2011 p.2045-2057
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