덧셈기와 쉬프트 연산을 사용한 저전력 MPEG audio 필터 구현 = Low-power MPEG audio filter implementation using adders and shift units

국문 초록 (Abstract)

이 논문에서는 MPEG audio 알고리즘의 FIR 필터를 덧셈을 사용하여 저전력으로 구현할 수 있는 구조를 제안하였다. 제안된 구조는 CSD 형의 계수를 사용하며, 입력신호 샘플을 최대로 공유함으로서 사용되는 덧셈기의 수를 최소화하였다. 제안된 구조는 알고리즘에서 사용된 공통입력 공유, 선형위상 대칭 필터계수를 이용한 공유, 공통입력을 이용한 블록 공유, CSD 형의 계수와 공통패턴 공유를 통하여 사용되는 덧셈의 수를 최소화할 수 있음을 보였다. Verilog-HDL 코딩을 통하여 시뮬레이션을 수행한 결과, 제안된 구조는 기존의 곱셈기 구조의 구현면적과 비교하여 39.73%로 감소됨을 보였다. 또한 제안된 구조의 전력소모도 곱셈기 구조와 비교하여 6.1%로 감소됨을 보였다. 따라서 고속의 곱셈기가 내장된 DSP 프로세서를 사용하지 않고도, Arithmetic Unit나 마이크로 프로세서를 사용하여 효과적으로 MPEG audio 필터를 구현할 수 있음을 보였다.