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      아날로그 PRML 디코딩 회로 구현 시의 미스 매칭 문제 완화를 위한 입력 심볼 에러 값 증폭 = Input Error Amplification for the Ease of Mismatching Problem in the Analog PRML Decoder Implementation

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      https://www.riss.kr/link?id=A76530606

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      국문 초록 (Abstract)

      차동형 아날로그 PRML 디코더의 하드웨어 구현 시에 발생하는 mismatching 문제를 해결하기 위해서 입력 심볼 에러를 증폭함으로써 에러 정정 효과를 향상시키는 방법을 제안하였다. 차동형 아날로그 PRML 비터비 디코더는 축약된 길이만큼의 트렐리스 다이아그램 회로를 2 개 구성하고, 그 중 한 회로는 0에 해당하는 가지들을 절단하고, 다른 회로는 1에 해당하는 가지들을 절단하여 두 회로의 출력을 비교함으로써 디코딩한다. 이 때, 두 회로 출력 값의 차이가 작을 경우에는 하드웨어 구현시의 mismatching 때문에 디코딩 에러가 발생할 수 있다. 본 논문에서는 입력 심볼 에러 값들을 증폭함으로서 큰 경로 에러값들은 saturation시키는 대신, 작은 경로 에러 값들 간에는 구별 성을 키움으로써 결과적으로 0 혹은 1 간의 구별 마진이 커지게 하는 방법을 제안하였다. 회로의 디코딩 성능 개선효과를 보이기 위해 시뮬레이션 결과를 제시하였다.
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      차동형 아날로그 PRML 디코더의 하드웨어 구현 시에 발생하는 mismatching 문제를 해결하기 위해서 입력 심볼 에러를 증폭함으로써 에러 정정 효과를 향상시키는 방법을 제안하였다. 차동형 아...

      차동형 아날로그 PRML 디코더의 하드웨어 구현 시에 발생하는 mismatching 문제를 해결하기 위해서 입력 심볼 에러를 증폭함으로써 에러 정정 효과를 향상시키는 방법을 제안하였다. 차동형 아날로그 PRML 비터비 디코더는 축약된 길이만큼의 트렐리스 다이아그램 회로를 2 개 구성하고, 그 중 한 회로는 0에 해당하는 가지들을 절단하고, 다른 회로는 1에 해당하는 가지들을 절단하여 두 회로의 출력을 비교함으로써 디코딩한다. 이 때, 두 회로 출력 값의 차이가 작을 경우에는 하드웨어 구현시의 mismatching 때문에 디코딩 에러가 발생할 수 있다. 본 논문에서는 입력 심볼 에러 값들을 증폭함으로서 큰 경로 에러값들은 saturation시키는 대신, 작은 경로 에러 값들 간에는 구별 성을 키움으로써 결과적으로 0 혹은 1 간의 구별 마진이 커지게 하는 방법을 제안하였다. 회로의 디코딩 성능 개선효과를 보이기 위해 시뮬레이션 결과를 제시하였다.

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      다국어 초록 (Multilingual Abstract)

      An idea to improve the performance of error correction with the amplification of input symbol errors is proposed to ease the mismatching problem which occurs in the hardware implementation of the differential analog PRML decoder. The differential analog PRML decoder is the decoder with two blocks of trellis diagram one of which is without branches of “0” and the other one is without the branches of “1”. Decoding is performed by comparing the outputs of two blocks. The decoding error is likely to occur when the difference of two outputs is very small and the hardware implementation is not precise due to mismatching. The proposed idea is to increase the discrimination margin for the output “0” and “1” by amplifying the symbol error while the larger path metrics are saturated. To show the performance improvement of decoding with the proposed idea, simulation results are included.
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      An idea to improve the performance of error correction with the amplification of input symbol errors is proposed to ease the mismatching problem which occurs in the hardware implementation of the differential analog PRML decoder. The differential anal...

      An idea to improve the performance of error correction with the amplification of input symbol errors is proposed to ease the mismatching problem which occurs in the hardware implementation of the differential analog PRML decoder. The differential analog PRML decoder is the decoder with two blocks of trellis diagram one of which is without branches of “0” and the other one is without the branches of “1”. Decoding is performed by comparing the outputs of two blocks. The decoding error is likely to occur when the difference of two outputs is very small and the hardware implementation is not precise due to mismatching. The proposed idea is to increase the discrimination margin for the output “0” and “1” by amplifying the symbol error while the larger path metrics are saturated. To show the performance improvement of decoding with the proposed idea, simulation results are included.

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      목차 (Table of Contents)

      • 요약
      • Abstract
      • Ⅰ. 서론
      • Ⅱ. 기존의 아날로그 비터비 디코더
      • Ⅲ. 제안한 구조를 이용한 입력 에러의 증폭에 의한 회로 미스매칭 문제 해결
      • 요약
      • Abstract
      • Ⅰ. 서론
      • Ⅱ. 기존의 아날로그 비터비 디코더
      • Ⅲ. 제안한 구조를 이용한 입력 에러의 증폭에 의한 회로 미스매칭 문제 해결
      • Ⅳ. 결론
      • 참고문헌
      • 저자소개
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      참고문헌 (Reference)

      1 P. G. Gulakand E. Shwedyk, "VLSI structures for viterbi receivers:Part I-general theory and applications" 4 : 142-154, 1986

      2 G. D. Forney, JR., "The viterbi algorithm" 61 (61): 1973

      3 F. Dolivo, "Signal processing for high-density magnetic recording" 1.91-1.96, 1989

      4 Sun-How Jiang, "PRML process of multilevel run length-limited modulation recording on optical disk" 41 (41): 1070-1072, 2005

      5 Kai He, "Integrated 64-state parallel analog Viterbi decoder" 761-764,

      6 Hyongsuk Kim, "High performance viterbi decoder with circularly connected 2-D CNN unilateral cell array" 52 (52): 2208-2218, 2005

      7 A.J. Viterbi, "Error bounds for convolution codes and asymptotically optimum decoding algorithm" 13 : 260-269, 1967

      8 P. R. Kinget, "Device mismatch and tradeoffs in the design of analog circuits" 40 (40): 1212-1224, 2005

      9 M. H. Shakiba, "Bicmos circuits for analog viterbi decoders" 45 (45): 1527-1537, 1998

      10 H. Kobayashi, "Application of partial response channel coding to magnetic recording system" IBM journal of research and development 368-375, 1970

      1 P. G. Gulakand E. Shwedyk, "VLSI structures for viterbi receivers:Part I-general theory and applications" 4 : 142-154, 1986

      2 G. D. Forney, JR., "The viterbi algorithm" 61 (61): 1973

      3 F. Dolivo, "Signal processing for high-density magnetic recording" 1.91-1.96, 1989

      4 Sun-How Jiang, "PRML process of multilevel run length-limited modulation recording on optical disk" 41 (41): 1070-1072, 2005

      5 Kai He, "Integrated 64-state parallel analog Viterbi decoder" 761-764,

      6 Hyongsuk Kim, "High performance viterbi decoder with circularly connected 2-D CNN unilateral cell array" 52 (52): 2208-2218, 2005

      7 A.J. Viterbi, "Error bounds for convolution codes and asymptotically optimum decoding algorithm" 13 : 260-269, 1967

      8 P. R. Kinget, "Device mismatch and tradeoffs in the design of analog circuits" 40 (40): 1212-1224, 2005

      9 M. H. Shakiba, "Bicmos circuits for analog viterbi decoders" 45 (45): 1527-1537, 1998

      10 H. Kobayashi, "Application of partial response channel coding to magnetic recording system" IBM journal of research and development 368-375, 1970

      11 Hyunjung Kim, "Analog viterbi decoder for PRML using analog parallel processing circuits of the CNN" 2006

      12 M. Moerz, "Analog decoders for high rate convolutional codes" IWT 2001 128-130,

      13 Jens Sparso, "An Area-Efficient Topology for VLSI Implementation of Viterbi Decoders and Other Shuffle-Exchange Type Structures" SC-26 (SC-26): 90-96, 1991

      14 Jane Maunu, "A differential architecture for an online analog viterbi decoder" 55 (55): 1133-1140, 2008

      15 R.D. Ciderciyan, "A PRML system for digital magnetic recording" 10 (10): 38-56, 1992

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      2014-01-21 학회명변경 영문명 : The Institute Of Electronics Engineers Of Korea -> The Institute of Electronics and Information Engineers
      2012-09-01 평가 학술지 통합(등재유지)
      2011-01-01 평가 등재학술지 유지(등재유지) KCI등재
      2009-01-01 평가 등재학술지 유지(등재유지) KCI등재
      2007-10-04 학술지명변경 한글명 : 전자공학회논문지 - SD</br>외국어명 : SemiconductorandDevices KCI등재
      2007-01-01 평가 등재학술지 유지(등재유지) KCI등재
      2005-01-01 평가 등재학술지 유지(등재유지) KCI등재
      2002-07-01 평가 등재학술지 선정(등재후보2차) KCI등재
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