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공유 메모리와 단일 버스로 구성되는 다중프로세서의 하드웨어 성능 분석
최창열(Chang Yeol Choi),박병관(Byung Kwan Park),박승규(Seung Kyu Park),오길록(Cil Rok Oh) 한국정보과학회 1989 정보과학회논문지 Vol.16 No.5
본 논문에서는 공유 메모리와 단일 버스로 구성되는 다중프로세서 컴퓨터시스팀인 행정전산망용 주전산기(TICOM-91)의 성능을 하드웨어 수준에서 분석하였다. 캐쉬 메모리 적중률, 시스팀 내의 프로세서 수, 메모리 모듈의 수 그리고 메모리 모듈의 입력 큐 유무를 변수로 하여 시스팀(어드레스, 데이타) 버스와 프로세서의 이용률, 메모리 상호 충돌의 정도를 시물레이션을 통해 예측하고 분석하였다. 주요한 시스팀 성능 결정 요소는 캐쉬 메모리의 적중률과 공유 메모리 갱신 알고리즘, 단일 시스팀 버스의 효율적인 다중프로세서 지원 기능 등이며, 캐쉬 메모리 적중률을 프로세서 수의 증가에 따른 시스팀 성능의 선형적인 증가와 밀접한 관계를 나타내었다. This paper describes the hardware design and its performance analysis of a multiprocessor system (TICOM-91), which is based on the shared memory and single system bus. The system bus supports a pended protocol for multiprocessor environment Cache coherency protocol based on the pended bus is employed to maintain the data consistency and to minimize the traffic on the shared system bus. A simulation model is used for analyzing the utilization of processors, address/data bus and the memory contentions. The hit ratio of private cache memory is major factor on the linear increase of the performance for a shared memory based multiprocessor system.
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