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데이터패스 합성시 CPLD를 이용한 partition 알고리듬 개발에 관한 연구
김희석 청주대학교 산업과학연구소 1998 産業科學硏究 Vol.15 No.3
In this paper, we proposed partitioning alogrithm for CPLD(Comp1ex Programmable Logic Device)s in datapath synthesis. Sometimes, datapath circuits are too large to be mappable it to a CPLD device. We proposed heuristic algorithm that partition large digital circuit to several CPLDs in consideration of the number of CPLD inputdoutputs. The characteristics of proposed algorithm are to represent circuit to hypergraph added direction, to represent the relation between hyperedge and vertex to matrix, and to be based K-L algorithm and F-M algorithm. After applying proposed partitioning alogorithm to many circuit and many CPLDs, we obtain satisfied results.
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企業引受와 長期經營成果와의 關係 : 거평그룹을 中心으로 Focused on Keopyung Group
金熙錫,曺敬植 大邱大學校 社會科學硏究所 1999 社會科學硏究 Vol.6 No.2
본 연구에서는 거평그룹의 타기업 인수가 장기적인 관점에서 그 기업의 경영성과에 어떠한 영향을 미치고 있는가를 분석하기 위하여 기업의 경영성과를 측정하는 가장 대표적인 지표로 인정받고 있는 총자본순이익률(ROA), 자기자본순이익률(ROE), 매출액순이익률(ROS)을 기준으로 인수전·후의 기업경영성과를 t-검정을 통하여 측정하였다. 분석결과 거평인수기업의 ROA, ROE, ROS와 산업평균지표간에는 유의적인 차이가 없는 것으로 밝혀졌는데, 이것은 거평그룹의 인수기업 경영성과가 인수로 인해 산업평균에 비해서 더 나아지지는 않았음을 나타낸다. 반면에 기업의 위험은 인수이전에 비해 더욱 증가하였는데, 이러한 현상은 거평그룹의 기업인수 역시 과거 대다수 우리나라 기업의 M&A에서와 같이 기업경영성과의 향상 또는 株主富의 극대화보다는 量的 外形불리기에 급급하였음을 보여 주는 것이라 할 수 있다.
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스트레오 카메라를 이용한 영상처리용 Rotation 블록 하드웨어 구현
김희석 청주대학교 2013 産業科學硏究 Vol.31 No.1
Rotation is a basic operation for image processing, and the complexity of its computation is considered as the key problem of the implementation of real-time visual system. This paper implements architecture based on CORDIC vector algorithm. The CORDIC algorithm compensates the scale factor in parallel with angle rotations, expands the convergence range to entire cosɵ set to 1. The detailed architecture for image rotation is modeled by Verilog and implemented in Xilinx FPGA. Experiment results show that the implemented CORDIC algorithm has the identical angel computation processed by Matlab and the architecture for real-time image rotation
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김희석 청주대학교 2011 産業科學硏究 Vol.29 No.1
An efficient image pre-processing algorithm to the license plate recognition and high-speed for edge computation hardware block is proposed. The proposed license plate localization algorithms analyze efficiently the characteristics of images of the actual speed camera and extract the plate region to improve the recognition rate through a pre-process of image processing. In addition, the proposed algorithm has reduced memory access time and arithmetic operations in the longest part of the operation process of creating edge image and the performance and verified in hardware block design. The proposed license plate program is implemented by C++ language and hardware block of high speed edge operation is also implemented by Verilog
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김희석 청주대학교 산업과학연구소 2001 産業科學硏究 Vol.19 No.1
In this paper, an improved methode of the performance ofr two-dimension IDCT design is proposed, which can be effectively reduced memory transposition step for 2D processing of IDCT By using an optimized memory step, a latency of our proposed IDCT is more faster than that of other existing TDCT systems Results show that latency is 28 clock for IDCT processing and estimated that area saying is more reduced comparing to other existing IDCT designs while its performance is more increased In experiment, our design is implemented with a CPLD device in Altera Co
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金熙錫,曺敬植 大邱大學校 社會科學硏究所 2001 社會科學硏究 Vol.9 No.1
본 연구는 우리나라 기업을 대상으로 1992년과 1995년 동안 공개된 기업 50개와 그 짝기업 (동일업종에 속하는 유사기업) 50개를 선정하여 공개전후 2년간 그 재무적 특성의 변화를 비교함으로써 기업공개효과를 분석하였다. 구체적으로는 두 집단 간 공개전후 투자지출, 배당성향, 부채의존도, 성장성, 수익성, 유동성, 기업위험, 단기차입금의존도 등의 변화를 상호비교하였다. 분석결과, 공개기업들은 기업공개 후 비공개기업에 비해 상대적으로 성장률이 더 높아지고, 유동성이 향상되었으며, 주주관계를 의식하여 배당성향은 증가한 것으로 나타나고, 또한 자본지출도 상대적으로 증가하였다. 그러나 수익성(총자산 영업이익률)은 오히려 상대적으로 악화된 것으로 나타났다. 한편, 부채의존도(부채구성비율), 단기차입금의존도(단기차입금/총부채), 기업위험(매출액영업이익률의 분산)에서는 두 집단간 통계적으로 유의적인 차이가 발견되지 않았다
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실시간 회전 영상 보정을 위한 고속 회전 각도 검출 알고리즘의 FPGA 설계
김희석 청주대학교 2018 産業科學硏究 Vol.35 No.2
In this paper, an efficient method of hardware design based on Field Programmable Gate Array (FPGA) to detect rotated angle of high definition image for real time process is proposed. Through the result both the proposed method and CORDIC, the proposed design is confirmed to have high operating speed of about 0.6ns with CORDIC. It is verified to have good performance results comparing than CORDIC with cost utilization of registers and Look Up Tables (LUTs) of 0.5% and 0.07%,respectively. The proposed method is implemented by XC702 FPGA board by using xilinx 14.7 tool .
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RGB에서 YCbCr 변환을 위한 컬러 시스템 의 FPGA 구현
김희석 청주대학교 2015 産業科學硏究 Vol.33 No.1
This paper explores the performance and architectural tradeoffs involved in the design of FPGA based realtime image processing systems. There are several coordinate systems which came into existence for variety of reasons. This paper discusses the use of restructurable hardware specifically field programming gate arrays, for RGB Color Space to YCbCr color Space. YCbCr color space is necessary in many video designs. The reference design files show RTL (Verilog) code to describe the conversion equations and synthesize to a target FPGA. The code is parameterizable for the input/outputprecision and the internal coefficient precision. Simulation results are also provided as an implementation example, placed and routed design in a Zynq device (xc7z020-1clg400) is presented.
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